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311.

위상고정회로를 사용한 AM신호 검파방식의 해석

문상재 대한전자공학회 電子工學會誌 6 Pages

대한전자공학회 電子工學會誌 1976, Vol.13 No.5 24-29 (6 pages)

문상재 저

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loop is used to extract a synchronous carrier from an input AM signal. Under the assumption that input noise is white Gaussian and free-running frequency of voltage controlled oscillator is the same that of an input carrier, operational behaviours of phase locked loop is analyzed and signal to noise ratio of the detection is derived quentitatively. The results show that the phase locked AM signal detection method offers a higher degree of noise mmunity than conventional AM signal detections.
312.

안정된 동기시신호발생을 이용한 인체 기능의 측정에 관한 연구

이행세, 이상혁, 김용득, Lee. Haing-Se, Lee. Sang-Hyeok, Kim. Yong-Deuk 대한전자공학회 電子工學會誌 8 Pages

대한전자공학회 電子工學會誌 1976, Vol.13 No.5 9-16 (8 pages)

이행세, 이상혁, 김용득, Lee. Haing-Se, Lee. Sang-Hyeok, Kim. Yong-Deuk 저

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설계를 위한 기초실험을 하였다. 종래의 복잡한 아날로그식의 변환과정을 모두 제거하고, 온도제어 주파수변환회로를 설계하여, 직접 온도에서 주파수로 A/D 변환을 행하였다. 기온범위에서 ±0.05℃의 오차한계를 얻었다. This paper deals with a method of measuring the temperature, purse, and pressure of a human body The temperature controlled oscillator was designed with a thermistor as a temperature measuring part The error in temperature was less than ±0.05℃ in the range of the temperature of a human...
313.

ULM을 이용한 디지탈회로의 간소화에 관한 연구

박규태, 김진복 대한전자공학회 電子工學會誌 6 Pages

대한전자공학회 電子工學會誌 1976, Vol.13 No.4 12-17 (6 pages)

박규태, 김진복 저

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이론적 결과와 대응함을 관찰하였다. This paper deals with characteristics and analysis of the Universal Logic Modules as well as TULM, QULM and SULM. Studies are made on minimization in Storms of symmetric circuits and theoretical stuides are made by using the symmetric functions The symmetric circuits of the ULM are realized by employing 54/74 ICs, An oscillator circuit of 10KHz. is constructed based on the ULM. The experimental results gave a good agreement with the theoretical Minimization.
314.

전자급수기에 관한 연구

박규태 대한전자공학회 電子工學會誌 6 Pages

대한전자공학회 電子工學會誌 1973, Vol.10 No.5 1-6 (6 pages)

박규태 저

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습도를 검출하여 reference level과 비교하여 필요한곳에 자동적으로 급수하도록 설계하였다. 이 system의 control을 위하여 main clock oscillator와 controloscillator를 사용하였고 control circuit로는 programmable unijunction transistor를 이용하여 reference level을 조절하게하여 임의의 원하는 습도에 급수하도록 하였다. 제작된 급수재는 모래의 습도가 6%에서 51%로 변화시키면서 실험하여 언제나 input level이 reference level보다 약 0.6V보다 높을때 완전동작하였으며 reference level은 임의로 조절할 수 있었다.
315.

A DPLL with a Modified Phase Frequency Detector to Reduce Lock Time

하산 타릭, 최광석, Hasan. Md. Tariq, Choi. GoangSeog 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 6 Pages

대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2013, Vol.50 No.10 76-81 (6 pages)

하산 타릭, 최광석, Hasan. Md. Tariq, Choi. GoangSeog 저

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130nm CMOS 공정 라이브러리를 이용하여 125MHz로 동작하는 새로운 위상 주파수 검출기 기반 DPLL을 설계하였다. 이 DPLL은 중간 주파수대 응용을 위해 지터와 록 시간을 줄이려고 전형적인 DPLL에 반전 에지 검출기를 포함하고 있다. XOR 기반 반전 에지 검출기들은 출력을 보다 빨리 변화시키기 위하여 기준 신호보다 빠른 전이를 얻는데 사용된다. HSPICE 시뮬 레이터는 모의실험을 위해 Cadence환경에서 사용되었다. 제안된 위상 주파수 검출기를 가진 DPLL의 성능은 종래의 위상 주 파수 검출기를 가진 것의 성능과 비교하였다....
316.

디지털 주파수 보정과 지터 제거 기법을 적용한 2.5 Gb/s 버스트 모드 클럭 데이터 복원기

정재훈, 정연환, 신동호, 김용신, 백광현, Jung. Jae-Hun, Jung. Yun-Hwan, Shin. Dong Ho, Kim. Yong Sin, Baek. Kwang-Hyun 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 9 Pages

대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2013, Vol.50 No.7 87-95 (9 pages)

정재훈, 정연환, 신동호, 김용신, 백광현, Jung. Jae-Hun, Jung. Yun-Hwan, Shin. Dong Ho, Kim. Yong Sin, Baek. Kwang-Hyun 저

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CDR에서는 입력 데이터율과 클럭 복원기의 개폐 전압제어발진기(GVCO: Gated Voltage Controlled Oscillator) 출력 주파수간의 불일치를 제거하기 위하여 디지털 주파수 보정 기법이 적용되었고, 또한 입력 데이터로 인하여 발생하는 지터(Jitter)를 감소시키기 위하여 지터 제거 기법이 적용되었다. 제안된 버스트 모드 CDR은 0.11 ${mu}m$ CMOS 공정을 사용하여 설계되었고 루프필터를 제외한 회로 설계 면적은 0.125 $mm^2$이며 전력 소모량은 94.5 mW이다. 포스트 레이아웃 시뮬레이션 결과, 제안된 회로를 통하여 복원된 데이터는...
317.

3D Device simulator를 사용한 공정과 Layout에 따른 FinFET 아날로그 특성 연구

노석순, 권기원, 김소영, Noh. SeokSoon, Kwon. KeeWon, Kim. SoYoung 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 8 Pages

대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2013, Vol.50 No.4 35-42 (8 pages)

노석순, 권기원, 김소영, Noh. SeokSoon, Kwon. KeeWon, Kim. SoYoung 저

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본 논문에서는 3차원 소자 시뮬레이터인 Sentaurus를 사용하여, spacer 및 selective epitaxial growth (SEG) 구조 등 공정적 요소를 고려한 22 nm 급 FinFET 구조에서 레이아웃에 따른 DC 및 AC 특성을 추출하여 아날로그 성능을 평가하고 개선방법을 제안한다. Fin이 1개인 FinFET에서 spacer 및 SEG 구조를 고려할 경우 구동전류는 증가하지만 아날로그 성능지표인 unity gain frequency는 total gate capacitance가 dominant하게 영향을 주기 때문에 동작 전압 영역에서 약 19.4 % 저하되는 것을 알 수 있었다. 구동전류가 큰 소자인...
318.

입력-결합 전류 제한 링 발진기와 하드웨어 효율적인 레벨 시프터를 적용한 저전력 안테나 스위치 컨트롤러 IC

임동구, Im. Donggu 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 5 Pages

대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2013, Vol.50 No.1 180-184 (5 pages)

임동구, Im. Donggu 저

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이 논문에서는 (SOI) CMOS 공정을 이용한 저전력 안테나 스위치 컨트롤러 IC가 설계되었다. 제안 된 컨트롤러는 전력 수용능력과 고조파 왜곡 성능을 향상시키기 위하여 입력 신호에 따라 안테나 스위치를 구성하는 FET소자의 게이트 단자와 바디 단자에 +VDD, GND 그리고 -VDD에 해당하는 3 가지 상태의 로직 레벨을 제공한다. 또한, 입력-결합 전류제한 링 발진기와 하드웨어 효율적인 레벨 시프터를 적용함으로서 전력소모와 하드웨어 복잡도를 크게 감소시켰다. 제안 된 회로는 +2.5 V 전원을 공급받으며 송신 모드에서 135 ${mu}A$를...
319.

65nm CMOS 공정을 이용한 전압제어발진기와 고속 4분주기의 설계

이종석, 문용, Lee. Jongsuk, Moon. Yong 대한전자공학회 Journal of the Institute of Electronics and Information Engineers 7 Pages

대한전자공학회 Journal of the Institute of Electronics and Information Engineers 2014, Vol.51 No.11 107-113 (7 pages)

이종석, 문용, Lee. Jongsuk, Moon. Yong 저

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60GHz 무선 통신 시스템에 적용 가능한 전압 제어 발진기와 고속 4분주기를 65nm CMOS 공정을 사용하여 설계했다. 전압제어 발진기는 전류소스와 NMOS 차동쌍 LC구조로 설계하였으며 분주기는 차동 인젝션 록킹 구조에 베렉터를 추가하여 동작주파수 범위를 조절할 수 있는 구조로 설계했다. 전압 제어 발진기와 분주기에 모두 전류소스를 추가하여 전원잡음에 따른 위상잡음 특성을 개선하였다. 전압 제어 발진기는 64.36~67.68GHz의 동작범위가 측정됐고, 고속 4분주기는 전압 제어 발진기의 동작범위에 대해 정확한 4분주가 가능하며...
320.

FinFET 게이트 저항 압축 모델 개발 및 최적화

이순철, 권기원, 김소영, Lee. SoonCheol, Kwon. Kee-Won, Kim. SoYoung 대한전자공학회 Journal of the Institute of Electronics and Information Engineers 8 Pages

대한전자공학회 Journal of the Institute of Electronics and Information Engineers 2014, Vol.51 No.8 30-37 (8 pages)

이순철, 권기원, 김소영, Lee. SoonCheol, Kwon. Kee-Won, Kim. SoYoung 저

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모델링함으로써, FinFET 게이트 저항의 비선형성을 반영하였다. 현재 제작되고 있는 FinFET에서 게이트가 두 물질(Tungsten, TiN)로 적층된 구조일 수 있음을 고려하여, 비저항이 서로 다른 물질을 적층 시킨 구조에 대한 압축 모델을 개발하였다. 제안하는 모델을 사용하여, 게이트의 기하학적 구조 변수 변화에 따른 게이트 저항이 최소가 되는 fin의 수를 제안하였다. BSIM-CMG에 제안하는 모델을 구현한 후, ring-oscillator를 설계하고, 게이트 저항이 고려되지 않았을 때와 고려되었을 때의 각단의 신호지연을 회로 시뮬레이터를...

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