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계층적 블록매칭 알고리즘을 위한 파이프라인식 VLSI 아키텍쳐
김형철, 맹승렬, Kim. Hyeong-Cheol, Maeng. Seung-Ryeol 한국정보처리학회 정보처리논문지 26 Pages
한국정보처리학회 정보처리논문지 1998, Vol.5 No.7 1691-1716 (26 pages)
본 논문에서는 계층적 블록매칭 알고리즘(HBMA)을 위한 두 가지 병렬 VLSI 아키텍쳐를 제안한다. HBMA는 계층에 따른 반복수행과 공간 인터폴레이션을 기반으로 수행되며, 이러한 수행 특성은 병렬처리의 장애요소인 데이터 종속성을 내재하고 있다. 제안된 아키텍쳐는 HBMA의 계층간 데이터 종속성을 해결하기 위하여 기본적으로 파이프라인 구조를 채택하고 있으며, HBMA에서 주어진 매개변수에 따라 세 단계의 스테이지로 구성된다. 제안된 아키텍쳐는 입력 프레임 데이터의 흐름을 제어하는 방식에 따라 두 가지 종류로 구분된다.... -
파이프라인 방식의 ASIC 데이타 경로를 위한 시간 정지형 콘트롤러의 자동 합성
김종태, Kim. Jong-Tae 한국정보처리학회 정보처리논문지 11 Pages
한국정보처리학회 정보처리논문지 1997, Vol.4 No.8 2152-2162 (11 pages)
본 논문은 파이프라인 방식의 ASIC 데이타 경로를 제어하기 위한 시간 정지형 콘트롤러의 자동합성에 관한 연구이다. 콘트롤 합성은 콘트롤 사양의 자동 생성과 유한상태기의 합성 및 최적화 단계로 구성된다. 이 유한상태기는 수평분할 방식을 응용하여 최적화되며 최소 면적의 콘트롤러가 합성된다. 실험을 통해 제안된 방식으로 생성된 콘트롤러와 기존 방식으로 합성된 유한상태기 콘트롤러를 비교하였는데 콘트롤러의 면적에서 있어서 큰 감소를 보여준다. -
분기 예측과 이중 경로 전략을 결합한 파이프라인 구조에 관한 연구
주영상, 조경산, Ju. Yeong-Sang, Jo. Gyeong-San 한국정보처리학회 정보처리논문지 10 Pages
한국정보처리학회 정보처리논문지 1996, Vol.3 No.1 181-190 (10 pages)
본 논문에서는 파이프라인 구조에서 분기 명령어로 인해 발생하는 제어적 문제를 개선하기 위한 분기예측 및 다중 경로 전략을 분석하여, 기존 예측 전략에서 간과하 였던 지연 사이클의 수를 줄일 수 있도록 예측 전략과 이중 결로 전략이 결합된 새로운 구조 및 전략을 제시한다. 또한, 기존의 예측 전략에서 예측성공 확률의 측도 로 사용하던 BEP 대신에 시스템 성능을 평가할 수 있는 CPI를 사용하여 기존의 제안 들에 대해 본 논문에서 제시된 구조 및 전략의 성능 개선을 제시한다. -
VLIW 시스템에서의 최소 시간 지연을 갖는 효율적인 병렬 파이프라인 알고리즘
서장원, 송진희, 류천열, 전문석, Seo. Jang-Won, Song. Jin-Hui, Ryu. Cheon-Yeol, Jeon. Mun-Seok 한국정보처리학회 정보처리논문지 11 Pages
한국정보처리학회 정보처리논문지 1995, Vol.2 No.4 466-476 (11 pages)
본 논문은 VLIW(Very Long Instruction Word) 시스템에 대한 파이프라이닝 알고리 즘 문제와 파이프라인 처리에서 발생되는 시간 지연을 최소화할 수 있는 효율적인 파 이프라인 처리 방법에 대해 서술하였다. 제안된 알고리즘은 병렬로 수행하면서 병렬 파이프라인 처리되며, 기본 오퍼레이션의 조합으로 응용 목적에 따라 다양한 기능을 수행하는 명령어의 설계가 가능하다. 본 논문에서는 프로세서의 파이프라인 알고리즘 효율성과 제안된 방법에 의해 시간 지연이 최소화됨을 다른 파이프라인 방법과의 비교 분석을 통해 증명해... -
파이프라인 방식의 ASIC 데이타 경로를 위한 무어 및 밀리식 시간 정지형 콘트롤 러의 자동 합성
김종태, Kim. Jong-Tae 한국정보처리학회 정보처리논문지 10 Pages
한국정보처리학회 정보처리논문지 1995, Vol.2 No.2 254-263 (10 pages)
본 논문은 파이프라인 방식의 ASIC 데이타 경로를 제어하기 위한 무어 및 밀리식 의 시간 정지형 콘트롤러에 관한 연구이다. 조건분기(conditional branches)를 가진 데이타흐름도로 부터 무어 및 밀리식의 유한상태기(finite state machine) 콘트롤러 를 합성하는 방법을 소개한다. 콘트롤 합성은 콘트롤 명세서의 작성과 유한상태기의 합성으로 구성된다. 콘트롤 명세서를 작성하기 위한 과정들을 통해 상태표(state table)의 형태로 표현되는 유한상태기의 내역이 작성된다. 이 유한상태기를 여러 가지 다른 방식의 분할 과정과 축소화... -
RISC 프로세서를 대상으로 한 최악 실행시간 분석의 정확도에 대한 과예측 원인별 영향 분석
김성관, 민상렬, 하란, 김종상 한국정보과학회 정보과학회논문지. Journal of KISS (c) : computing practices. C 12 Pages
한국정보과학회 정보과학회논문지. Journal of KISS (c) : computing practices. C 1999, Vol.5 No.4 467-478 (12 pages)
of programs statically. Second, pipelined execution and caching found in recent RISC-style processors even more complicate such a prediction. Although these overestimation sources have been attacked in many existing analysis techniques, we cannot find in the literature any description about questions like which one is most important. Thus, in this paper, we quantitatively analyze the impacts of overestimation sources on the accuracy of the worst case timing analysis. Using the results, we can... -
멀티프로그래밍 환경에서의 분기 예측
이문상, 강영재, 맹승렬 한국정보과학회 정보과학회논문지. Journal of KISS (a):computer systems and theory. A 8 Pages
한국정보과학회 정보과학회논문지. Journal of KISS (a):computer systems and theory. A 1999, Vol.26 No.9 1158-1165 (8 pages)
유지하는 분기 예측 방법이다.Abstract There is wide agreement that one of the most important impediments to the performance of current and future pipelined superscalar processors is the presence of conditional branches in the instruction stream. Accurate branch prediction is required to overcome this performance limitation. Many branch predictors have been proposed to help to alleviate this problem, including the two-level adaptive branch predictor, and more recently, hybrid branch predictor. In... -
High-Performance Low-Power FFT Cores
Han. Wei, Erdogan. Ahmet T., Arslan. Tughrul, Hasan. Mohd. 한국전자통신연구원 ETRI journal 10 Pages
한국전자통신연구원 ETRI journal 2008, Vol.30 No.3 451-460 (10 pages)
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1-D CGRA에서의 H.264/AVC 디블록킹 필터 구현
송세현, 김기철, Song. Sehyun, Kim. Kichul 한국전기전자학회 전기전자학회논문지 10 Pages
한국전기전자학회 전기전자학회논문지 2013, Vol.17 No.4 418-427 (10 pages)
1-D CGRA (coarse grained reconfigurable architecture)인 PRAGRAM (pipelined reconfigurable arrays with assistant manager groups)에서 처리된다. 디블록킹 필터 연산은 PRAGRAM의 단방향 파이프라인 PE 배열 구조를 이용하여 각 필터 연산을 고속으로 수행하고, dynamic reconfiguration 및 conditional reconfiguration을 이용하여 필터 선택과 조건 연산을 효율적으로 처리한다. 디블록킹 필터의 병렬 알고리즘은 매크로블록 당 225 사이클을 소요한다. 이는 동작주파수 150 MHz에서 full HD급 영상을 처리할 수 있는 성능이다.