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반전층에서의 애벌런치 현상을 이용한 냉음극
이정용, Lee. Jung-Yong 한국진공학회 韓國眞空學會誌 10 Pages
한국진공학회 韓國眞空學會誌 2007, Vol.16 No.6 414-423 (10 pages)
Emission Display)는 특히 소형, 고품질 평면화면분야에서 종래의 기술들과 뚜렷이 구별되는 이점을 가지고 있다. FED를 실리콘 웨이퍼에 System-on-Chip(SoC)화하는 가능성을 검토하기 위해, 우리는 p-n 접합을 평면 디스플레이의 전자선원(electron beam source)으로 사용할 수 있는지를 실험하였다. Cantilever(외팔보)형 게이트로부터의 전계로 반전층을 형성하여 p-n 접합을 형성하는 새로운 구조를 제조하였다. 약 1 ${mu}m$ 정도의 높이에 있는 cantilever형 게이트에 220V이상의 전압을 가했을 때 반전층(inversion layer)이... -
고주파 시스템 온 칩 응용을 위한 온 칩 검사 대응 설계 회로
류지열, 노석호, Ryu. Jee-Youl, Noh. Seok-Ho 한국정보통신학회 한국해양정보통신학회논문지 7 Pages
한국정보통신학회 한국해양정보통신학회논문지 2011, Vol.15 No.3 632-638 (7 pages)
본 논문은 고주파 시스템 온 칩 응용을 위한 온 칩 검사 대응 설계 (Design-for-Testability, DFT) 회로를 제안한다. 이러한 회로는 고주파 회로의 주요 성능 변수들 즉, 입력 임피던스, 전압이득, 잡음지수, 입력 전압 정재비 (VSWRin) 및 출력 신호대 잡음비 (SNRout)를 고가의 장비없이 측정 가능하다. 이러한 고주파 검사 회로는 DFT 칩으로부터 측정된 출력 DC 전압에 실제 고주파 소자의 성능을 제공하는 자체 개발한 이론적인 수학적 표현식을 이용한다. 제안한 DFT 회로는 외부 장비를 이용한 측정 결과와 비교해 볼 때 고주파... -
SoC 플랫폼 상에서 임베디드 블루투스 오디오 스트리밍 솔루션 개발
김태현, Kim. Tae-Hyoun 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 10 Pages
한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2006, No.0 589-598 (10 pages)
(System-on-Chip) 플랫폼 상에서 임베디드 블루투스 솔루션의 개발과 최적화에 대해 설명한다. 개발된 솔루션을 이식성을 고려해서 가상 운영체제 상에서 구현된 임베디드 블루투스 프로토콜 스택, 프로파일과 타겟 멀티미디어 SoC의 특성을 이용한 최적화 기법들을 포함한다. 수요 최적화 기법으로는 SoC 내의 스크래치 패드 메모리의 활용을 통한 메모리 접근 최소화, DSP 연산과 병렬 메모리 접근 명령을 이용한 코덱 구현, 무선 통신 환경을 고려한 동적 오디오 품질 조정 등이 있다. 실험 결과는 본 연구에서 제안한 최적화 기법을... -
융선추적을 이용한 지문 특징점 추출기의 SoC 구현
김기철, 박덕수, 정용화, 반성범 한국정보보호학회 情報保護學會論文誌 11 Pages
한국정보보호학회 情報保護學會論文誌 2004, Vol.14 No.5 97-107 (11 pages)
사용자 인증분야에서 가장 널리 사용되는 지문의 특징점 추출기의 SoC(System-on-Chip) 구현을 보인다. 일반적인 지문 특징점 추출 방식은 이진화, 세선화 방법을 사용하는데, 저화질 지문 이미지의 경우 많은 오류가 발생하여 지문인식시스템 전체의 정확도를 떨어뜨리는 문제가 있다. 이러한 문제를 해결하기 위해 지문 이미지에서 융선을 직접 추적하여 특징점을 추출하는 알고리즘이 제안되었으나, 연산량이 많아 스마트카드와 같은 소규모 시스템에서 소프트웨어만으로 수행하기 어렵다는 문제점이 있다. 본 논문에서는 융선추적... -
저전력 SoC을 위한 동적 주파수 제어 시스템의 FPGA 프로토타입 설계
정은구, 다이아나 마르쿨레수, 이정근, Jung. Eun-Gu, Marculescu. Diana, Lee. Jeong-Gun 한국정보과학회 정보과학회논문지. Journal of KIISE. 컴퓨팅의 실제 및 레터 5 Pages
한국정보과학회 정보과학회논문지. Journal of KIISE. 컴퓨팅의 실제 및 레터 2009, Vol.15 No.11 801-805 (5 pages)
하드웨어 기반 동적 전압 및 주파수 제어 시스템은 전역 비동기 지역 동기 시스템 설계 방식을 이용하여 동종의 멀티 코어 혹은 이종의 멀티 코어 시스템을 저전력으로 설계하기 위한 핵심 기술 중의 하나이다. 본 논문에서 하드웨어 기반 동적 주파수 제어 시스템의 FPGA 프로토타입 설계를 위해서 동적 주파수 제어기를 제안하고, 이를 FIFO 기반 멀티코어를 이용한 소프트웨어 정의 무선 설계와 네트워크 온 칩 기반의 하드웨어 HPEG2 인코더 설계에 적용하였다. 기존의 단일 주파수 시스템에 비해서 소프트웨어 정의 무선 설계의 경우... -
다중 버스 기반 온칩 통신 구조의 정량적 분석
이재성, Lee. Jaesung 한국정보과학회 정보과학회논문지. Journal of KIISE. 시스템 및 이론 11 Pages
한국정보과학회 정보과학회논문지. Journal of KIISE. 시스템 및 이론 2013, Vol.40 No.6 301-311 (11 pages)
최근 SoC 업계에서는 다양한 다중 버스 구조가 사용되고 있다. 그러나, 무분별한 버스 층의 남용은 온칩 통신 자원 및 실리콘 면적의 낭비를 초래한다. 이러한 낭비를 막기 위해 본 논문은 최적의 성능을 갖는 다중 버스 구조를 탐색하기 위한 정량적 분석 방법을 소개한다. 본 방법은 수학적 모델링을 통하여 다양한 온칩 버스 프로토콜의 특성을 반영하여 서로 다른 프로토콜을 기반으로 합성된 버스 구조 간 비교가 가능하다. 탐색에 걸리는 시간 복잡도에 대해 조사를 수행하여 그 규모가 O($n^n$)인 NP-complete 문제임을 인지하고... -
데이터 워드간 상관관계를 활용한 저전력 온칩 버스 직렬화 방법
이재성, Lee. Jaesung 한국정보과학회 정보과학회논문지. Journal of KIISE. 시스템 및 이론 8 Pages
한국정보과학회 정보과학회논문지. Journal of KIISE. 시스템 및 이론 2012, Vol.39 No.5 325-332 (8 pages)
온 칩 버스 직렬화에서 가장 중요한 문제 중 하나로 전력소비의 증가로 들 수 있다. 일반적으로 직렬통신은 비트 멀티 플렉싱 때문에 병렬 통신보다 더 많은 전력을 소모한다. 본 논문은 저전력 온칩 버스 직렬화를 위한 버스 코딩 방법을 제안한다. 본 방법은 기존의 병렬 버스 신호에 있어 워드간 또는 비트간 상관관계를 최대한 유지 및 활용함으로써 이진화시 신호의 변동 횟수가 크게 증가하지 않도록 직렬화 이전에 인코딩하는 방법이다. VC-1 멀티미디어 프로세서의 개정 과정에 본 방법을 적용한 후 시뮬레이션을 수행한 결과... -
SNP : 시스템 온 칩을 위한 새로운 통신 프로토콜
이재성, 이혁재, 이찬호, Lee. Jaesung, Lee. Hyuk-Jae, Lee. Chanho 한국정보과학회 정보과학회논문지. Journal of KIISE. 시스템 및 이론 10 Pages
한국정보과학회 정보과학회논문지. Journal of KIISE. 시스템 및 이론 2005, Vol.32 No.9 465-474 (10 pages)
고집적 SoC 설계시에 버스방식의 온칩 통신은 대역폭이 제한되는 문제점이 있고 NoC (Network-on-Chip) 방식에서는 구현의 복잡도가 증가하는 문제점이 있다. 본 논문에서는 이러한 문제점을 극복하는 새로운 온칩 통신 규격인 SNP(Soc Network Protocol)를 소개한다. SNP는 기존 버스의 신호선들을 세 가지 그룹인 제어(control), 주소(address), 데이타(data)로 나눈 뒤 하나의 채널을 통해 전송함으로써 신호선의 수를 줄인다. SNP 채널은 대칭구조로 사용되기 때문에 마스터-슬레이브 통신 방식뿐만 아니라 마스터-마스터 통신도... -
고속 SoC를 위한 클락 듀티 보정회로의 설계
한상우, 김종선, Han. Sang Woo, Kim. Jong Sun 한국산업정보학회 한국산업정보학회논문지 8 Pages
한국산업정보학회 한국산업정보학회논문지 2013, Vol.18 No.5 51-58 (8 pages)
본 논문에서는 고속 SoC 설계시 필요한 클록킹 회로의 핵심 소자인 클록 듀티 보정회로 (Duty-Cycle Corrector: DCC)를 소개한다. 종래의 아날로그 피드백 DCC와 디지털 피드백 DCC의 구조와 동작에 대해 비교 분석한다. 듀티-보정 레인지의 확장과 동작 주파수 및 듀티-보정 정확도의 향상을 위해 아날로그와 디지털 DCC의 장점을 결합한 새로운 혼성-모드 피드백 DCC를 소개한다. 특히, 혼성-모드 DCC의 핵심 구성 회로인 듀티-앰프 (Duty-Cycle Amplifier: DCA)의 구조와 설계에 대해 자세히 소개한다. 싱글-스테이지 DCA와...