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131.

VCG를 사용한 GF(2m)상의 고속병렬 승산기 설계에 관한 연구

성현경, Seong. Hyeon-Kyeong 한국정보통신학회 한국해양정보통신학회논문지 9 Pages

한국정보통신학회 한국해양정보통신학회논문지 2010, Vol.14 No.3 628-636 (9 pages)

성현경, Seong. Hyeon-Kyeong 저

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본 논문에서는 GF($2^m$)상의 표준기저를 사용한 새로운 형태의 VCG에 의한 고속병렬 승산회로를 제안하였다. 승산기의 구성에 앞서, 피승수 다항식과 기약다항식의 승산을 병렬로 수행하는 벡터 코드 생성기(VCG) 기본 셀을 설계하였고, VCG 회로와 승수 다항식의 한 계수와 비트-병렬로 승산하여 결과를 생성하는 부분 승산결과 셀(PPC)를 설계하였다. 제안한 승산기는 VCG와 PPC를 연결하여 고속의 병렬 승산을 수행한다. VCG 기본 셀과 PPC는 각각 1개의 AND 게이트와 1개의 XOR 게이트로 구성된다. 이러한 과정을 확장하여 m에 대한...
132.

고주파 강조필터를 이용한 의료영상의 화질향상을 위한 최적화 방법

신충호, 정채영, Shin. Choong-Ho, Jung. Chai-Yeoung 한국정보통신학회 한국정보통신학회논문지 5 Pages

한국정보통신학회 한국정보통신학회논문지 2014, Vol.18 No.7 1681-1685 (5 pages)

신충호, 정채영, Shin. Choong-Ho, Jung. Chai-Yeoung 저

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의료영상의 화질이 진단의 정확성에 중요한 요소이다. 그러므로 의료영상의 화질을 향상시킬 수 있는 방법들이 연구되어져 왔다. 그 중에서 주파수 도메인 필터가 영상의 화질을 향상시킬 수 있는 강력한 도구이다. 본 논문에서는 X선 의료영상에 기존의 고주파통과 필터에 최적값을 적용해서 에지영역을 개선하였고, 결과영상에 기존의 고주파 강조 필터에 최적값을 사용하여 에지영역 및 평탄영역의 대비를 향상시켰다. 마지막으로, 최소평균제곱오차필터를 사용해서 결과영상에 잡음을 최소화했다. 결과적으로, 제안된 방법이 기존...
133.

최적화된 고주파 강조 필터를 이용한 의료영상의 개선

신충호, 정채영, Shin. Choong-Ho, Jung. Chai-Yeoung 한국정보통신학회 한국정보통신학회논문지 7 Pages

한국정보통신학회 한국정보통신학회논문지 2013, Vol.17 No.3 698-704 (7 pages)

신충호, 정채영, Shin. Choong-Ho, Jung. Chai-Yeoung 저

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영상개선을 위한 영상처리는 응용분야에 따라서 동일한 알고리즘이 각각 다르게 적용되므로 응용분야에 적합한 최적값이 필요하다. 본 논문에서는 X선 의료영상분야에 고주파통과 필터를 적용해서 에지영역을 개선하였고, 결과영상에 상수승수와 오프셋을 더하여 에지영역 및 평탄영역의 컨트라스트를 향상시켰다. 그러므로, 의료영상을 최적화시키기 위해서는 고주파강조필터가 필요함을 알 수 있었다. 또한, 구체적인 최적화 변수값으로는 가우시안 고주파통과필터, 차단주파수의 거리=0.05, 오프셋=0.5 값이다. 마지막으로 이들 최적화...
134.

GF(2m)상의 MSD 우선 알고리즘 기반 디지트-시리얼 곱셈기

김창훈, 김순철, Kim. Chang-Hoon, Kim. Soon-Cheol 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 6 Pages

한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2008, No.0 161-166 (6 pages)

김창훈, 김순철, Kim. Chang-Hoon, Kim. Soon-Cheol 저

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본 논문에서는 유한체 GF($2^m$)상의 다항식 기저를 이용한 디지트 시리얼 시스톨릭 곱셈기를 제안한다. 제안된 곱셈기는 MSD(Most Significant Digit) 우선 곱셈 알고리즘에 기반하며, 연속적인 입력 데이터에 대해 "m/D" 클럭 사이클마다 곱셈 결과를 출력한다. 여기서 D는 선택된 디지트 크기이다. 기존에 제안된 구조들은 선형의존성 때문에 디지트 크기 D가 증가하면 최대 처리기 지연시간 역시 선형으로 증가하지만 제안된 곱셈기는 이진트리 형태의 내부 구조를 가지기 때문에 D에 대해 로그단위로 증가한다. 따라서...
135.

전류모드 CMOS 4치 논리회로를 이용한 64×64-비트 변형된 Booth 곱셈기 설계

김정범, Kim. Jeong-Beom 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 6 Pages

한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2007, No.0 203-208 (6 pages)

김정범, Kim. Jeong-Beom 저

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본 논문에서는 CMOS 다치 논리회로를 이용하여 $64{ imes}64$ 비트 Modified Booth 곱셈기를 설계하였다. 설계한 곱셈기는 Radix-4 알고리즘을 이용하여 전류모드 CMOS 4치 논리회로로 구현하였다. 이 곱셈기는 트랜지스터 수를 기존의 전압모드 2진 논리 곱셈기에 비해 64.4% 감소하였으며, 내부 구조를 규칙적으로 배열하여 확장성을 갖도록 설계하였다. 설계한 회로는 2.5V의 공급전압과 단위전류 $5{mu}A$를 사용하여, $0.25{mu}m$ CMOS 기술을 이용하여 구현하였으며 HSPICE를 사용하여 검증하였다. 시뮬레이션 결과, 2진 논리...
136.

전류모드 CMOS에 의한 다치 가산기 및 승산기의 구현

성현경, Seong. Hyeon-Kyeong 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 8 Pages

한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2004, No.0 115-122 (8 pages)

성현경, Seong. Hyeon-Kyeong 저

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본 논문에서는 전류모드 CMOS를 사용하여 다치 가산기 및 다치 승산기를 구현하였으며, 먼저 효과적인 집적회로 설계 이용성을 갖는 전류모드 CMOS를 사용하여 3치 T-게이트와 4치 T-게이트를 구현하였다. 구현된 다치 T-게이트를 조합하여 유한체 $GF(3^2)$의 2변수 3치 가산표와 승산표를 실현하는 회로를 구현하였으며, 이들 다치 T-게이트를 사용하여 유한체 $GF(4^2)$의 2변수 4치 가산표와 승산표를 실현하는 회로를 구현하였다. 또한, Spice 시뮬레이션을 통하여 이 회로들에 대한 동자특성을 보였다. 다치 가산기 및 승산기들은...
137.

유한체 GF(2m)상의 셀 배열 병렬 승산기의 설계

성현경, Seong. Hyeon-Kyeong 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 10 Pages

한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2004, No.0 1-10 (10 pages)

성현경, Seong. Hyeon-Kyeong 저

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본 논문에서는 유한체 GF$(2^m)$상에서 두 다항식의 승산을 실현하는 병렬-입력 및 병렬-출력을 갖는 셀 배열 병렬 승산기를 제시한다 이 승산기는 승산연산부, 기약다항식연산부. MOD연산부로 구성한다. 승산연산부는 AND 게이트와 XOR 게이트로 설계한 기본 셀의 배열로 이루어지며, 기약다항식연산부는 XOR 게이트와 D 플림플롭회로를 사용하여 구성하며, MOD연산부는 AND 게이트와 XOR 게이트에 의한 기본 셀을 배열하여 구성하였다. 제시한 승산기는 PSpice 시뮬레이션을 통하여 동작특성을 보였으며, 클럭신호의 주기를 l${mu}...
138.

새로운 연산 공유 승산기를 이용한 1차원 DCT 프로세서의 설계

이태욱, 조상복, Lee. Tae-Wook, Cho. Sang-Bock 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 10 Pages

한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2003, No.0 347-356 (10 pages)

이태욱, 조상복, Lee. Tae-Wook, Cho. Sang-Bock 저

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DCT 알고리즘은 내적을 효율적으로 처리할 수 있는 하드웨어 구조가 필수적이다. 내적 연산을 위한 기존의 방법들은 하드웨어 복잡도가 높기 때문에, 이론 줄이기 위한 방법으로 연산 공유 승산기가 제안되었다. 하지만 기존의 연산 공유 승산기는 전처리기 및 선택기의 비효율적 구조로 인한 성능저하의 문제점을 가지고 있다. 본 논문에서는 새로운 연산 공유 승산기를 제안하고 이를 1차원 DCT 프로세서에 적용하여 구현하였다. 연산 공유 승산기의 구조 및 논리 합성 비교 시 새로운 승산기는 기존에 비해 효율적인 하드웨어 구성이...
139.

유한 필드 GF(2m)상에서의 LSB 우선 디지트 시리얼 곱셈기 구현

김창훈, 홍춘표, 우종정, Kim. Chang-Hun, Hong. Chun-Pyo, U. Jong-Jeong 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 6 Pages

한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2002, No.0 281-286 (6 pages)

김창훈, 홍춘표, 우종정, Kim. Chang-Hun, Hong. Chun-Pyo, U. Jong-Jeong 저

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본 논문에서는 유한 필드 GF$(2^m)$상에서 모듈러 곱셈 $A({ imes})B$ mod G,({ imes})를 수행하는 LSB 우선 디지트 시리얼 시스톨릭 곱셈기를 구현하였다. 구현된 곱셈기는 디지트의 크기를 L로 설정했을 경우 연속적인 입력 데이터에 대해 [m/L] 클럭 사이클 비율로 곱셈의 결과를 출력한다. 본 연구에서 구현된 곱셈기를 기존의 곱셈기와 비교 분석한 결과, 더 간단한 하드웨어 구조를 가지고, 데이터 처리 지연 시간이 감소되었다. 또한 본 연구에서 제안한 구조는 단방향의 신호 흐름 특성을 가지고 있으며, 매우 규칙적이기 때문에...
140.

승산시간 향상을 위한 병렬 승산기 어레이 설계에 관한 연구

이강현, Lee. Gang-Hyeon 한국정보처리학회 정보처리논문지 5 Pages

한국정보처리학회 정보처리논문지 1995, Vol.2 No.6 969-973 (5 pages)

이강현, Lee. Gang-Hyeon 저

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본 논문에서는 기존의 병렬 승산기 어레이에서 사용된 CSA(carry select adder) 셀 구조를 수정하여 승산시간을 감소하는 새로운 병렬 승산기 어레이를 제안한다. MCSA(modified CSA)의 입력에 가수와 피가수가 자리올림보다 먼저 인가된다. 그리고 자리올림 전달 가산기를 위하여 DCSA(doubled inverted imput CSA)를 설계하여 최종 승산항 다음에 추가한다. 제안된 안은 MCSA와 DCSA를 사용하여 설계하고 모의실험을 한다. 회로의 크기는 기존의 CAS셀을 사용한 기존의 승산기 어레이에 비하여 약 13% 증가했지만 연산시간은 약 52%...

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