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LCD 시스템을 위한 Current-Mode Multi-Valued Logic 인터페이스 회로
황보현, 신인호, 이태희, 최명렬, Hwang. Bo-Hyoun, Shin. In-Ho, Lee. Tae-Hee, Choi. Myung-Ryul 대한전기학회 전기학회논문지. The Transactions of the Korean Institute of Electrical Engineers. P 6 Pages
대한전기학회 전기학회논문지. The Transactions of the Korean Institute of Electrical Engineers. P 2013, Vol.62 No.2 84-89 (6 pages)
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Characteristics of a High Power Factor Boost Converter with Continuous Current Mode Control
Kim. Cherl-Jin, Jang. Jun-Young 대한전기학회 KIEE international transactions on electrical machinery and energy conversion systems 8 Pages
대한전기학회 KIEE international transactions on electrical machinery and energy conversion systems 2004, No.0 65-72 (8 pages)
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Design of $GF(3^m)$ Current-mode CMOS Multiplier
나기수, 변기녕, 김흥수, Na. Gi-Soo, Byun. Gi-Young, Kim. Heung-Soo 한국전기전자학회 전기전자학회논문지 9 Pages
한국전기전자학회 전기전자학회논문지 2004, Vol.8 No.1 54-62 (9 pages)
본 논문에서는 $GF(3^m)$상의 전류모드CMOS 승산기의 설계에 관하여 논의한다. 피 승산항에 원시원소 α를 곱함으로써 나타나는 피 승산항의 변화를 표준기저 표현을 이용하여 수식으로 전개하였다. $GF(3^m)$ 승산 회로를 구성하기 위하여 전류모드 CMOS를 사용하여 GF(3)상의 가산기와 승산기를 설계하였고 시뮬레이션 결과를 보였다. 기본 게이트들을 이용하여 $GF(3^m)$ 승산기를 설계하였고 m=3인 경우에 대하여 예를 보였다. 본 논문에서 제안한승산회로는 그 구성이 블록의 형태로 이루어지므로 $GF(p^m)$ 상에서 p와 m에 대한... -
A Novel Fuzzy Logic Control Technique tuned by Particle Swarm Optimization for Maximum Power Point Tracking for a Photovoltaic System using a Current-mode Boost Converter with Bifurcation Control
Khaehintung. Noppadol, Kunakorn. Anantawat, Sirisuk. Phaophak 제어로봇시스템학회 International Journal of Control, Automation and Systems 12 Pages
제어로봇시스템학회 International Journal of Control, Automation and Systems 2010, Vol.8 No.2 289-300 (12 pages)
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ESD 보호 소자를 탑재한 Peak Current-mode DC-DC Buck Converter
박준수, 송보배, 유대열, 이주영, 구용서, Park. Jun-Soo, Song. Bo-Bae, Yoo. Dae-Yeol, Lee. Joo-Young, Koo. Yong-Seo 한국전기전자학회 전기전자학회논문지 6 Pages
한국전기전자학회 전기전자학회논문지 2013, Vol.17 No.1 77-82 (6 pages)
논문에서는 인덕터의 흐르는 전류를 감지하여 출력 전압을 일정하게 유지시키는 Peak Current-mode 방식의 DC-DC Buck Converter를 제안하고, 소신호 모델링에 기초하여 Power Stage 설계 방법과 시스템의 안정도를 설계하는 방법을 제안한다. 또한, dc-dc 컨버터의 신뢰성과 성능을 향상시키기 위해 보호회로를 추가하였다. 그리고 정전기 방지를 위하여 ESD 보호회로를 제안하였다. 제안된 보호회로는 게이트-기판 바이어싱 기술을 이용하여 낮은 트리거 전압을 구현하였다. 시뮬레이션 결과는 일반적인 ggNMOS의 트리거 전압(8.2V) 에...