학지사 뉴논문

221.

다중 안테나 통신 시스템을 위한 효율적인 심볼 검출기 설계 연구

장수현, 한철희, 최성남, 곽재섭, 정윤호, Jang. Soo-Hyun, Han. Chul-Hee, Choi. Sung-Nam, Kwak. Jae-Seop, Jung. Yun-Ho 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 10 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2010, Vol.47 No.3 41-50 (10 pages)

장수현, 한철희, 최성남, 곽재섭, 정윤호, Jang. Soo-Hyun, Han. Chul-Hee, Choi. Sung-Nam, Kwak. Jae-Seop, Jung. Yun-Ho 저

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공간 다중화 모드를 모두 지원하며, ML 수준의 성능을 제공한다. 또한, 다단 (multi-stage) 파이프라인 구조와 극좌표 형태의 복소수 승산 방법을 사용하여 연산 블록의 공유와 연산기의 단순화를 진행하였고, 이를 통해 하드웨어 복잡도를 크게 감소시켰다. 제안된 하드웨어 구조는 하드웨어 설계 언어(HDL)를 이용하여 설계 되었고, Xilinx Virtex-5 XC5VLX220 FPGA에 기반하여 구현되었다. 그 결과 기존의 설계 구조와 비교시 35.3% 감소된 logic slices, 85.3% 감소된 DSP48s (dedicated multiplier)로 구현 가능함을 확인하였다.
222.

GF($3^m$)의 Digit-Serial 유한체 곱셈기

장남수, 김태현, 김창한, 한동국, 김호원, Chang. Nam-Su, Kim. Tae-Hyun, Kim. Chang-Han, Han. Dong-Guk, Kim. Ho-Won 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2008, Vol.45 No.10 23-30 (8 pages)

장남수, 김태현, 김창한, 한동국, 김호원, Chang. Nam-Su, Kim. Tae-Hyun, Kim. Chang-Han, Han. Dong-Guk, Kim. Ho-Won 저

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최근 페어링 기반의 암호시스템에 대한 연구가 활발히 진행되고 있으며, 암호시스템의 효율성은 기존의 공개키 암호시스템과 같이 유한체에 의존한다. 페어링 기반의 암호시스템의 경우 주로 GF($3^m$)에서 고려되며 유한체 연산에서 곱셈 연산이 효율성에 가장 큰 영향을 미친다. 본 논문에서는 삼항 기약다항식 기반의 새로운 GF($3^m$) MSD-first Digit-Serial 곱셈기를 제안한다. 제안하는 MSD-first Digit-Serial 곱셈기는 모듈러 감산 연산부를 병렬화하여 공간복잡도는 기존의 결과와 거의 같으나 Critical Path Delay가 기존의...
223.

저 전력 버퍼 회로를 이용한 무선 모바일 용 스텝다운 DC-DC 변환기

조대웅, 김석진, 박승찬, 임동균, 장경운, 윤광섭, Cho. Dae-Woong, Kim. Soek-Jin, Park. Seung-Chan, Lim. Dong-Kyun, Jang. Kyung-Oun, Yoon. Kwang-Sub 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 7 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2008, Vol.45 No.9 1-7 (7 pages)

조대웅, 김석진, 박승찬, 임동균, 장경운, 윤광섭, Cho. Dae-Woong, Kim. Soek-Jin, Park. Seung-Chan, Lim. Dong-Kyun, Jang. Kyung-Oun, Yoon. Kwang-Sub 저

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본 논문은 0.35$mu$m CMOS 공정으로 설계된 무선 모바일 시스템의 전력구동을 위한 3.3V 입력 1.8V 출력의 스텝다운 전압모드 DC-DC 변환기를 제안한다. 제안된 커패시터 멀티플라이어 기법은 오차보정중폭기의 보상회로 블록의 크기를 30%까지 줄여서 칩 안에 집적화 하였다. 이를 통하여 회로의 안정성을 향상시키기 위해서 칩 외부에 위치되었던 수동소자들이 없어지게 되었다. 또한 저 전력 버퍼를 이용해서 기존의 DC-DC 변환기보다 효율을 평균 3%정도 향상 시켰다. 제안한 변환기는 측정 결과, 부하전류 200mA에서 1.17%의 미만의...
224.

고속 비트-직렬 유한체 곱셈기

장남수, 김태현, 이옥석, 김창한, Chang. Nam-Su, Kim. Tae-Hyun, Lee. Ok-Suk, Kim. Chang-Han 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 6 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2008, Vol.45 No.2 49-54 (6 pages)

장남수, 김태현, 이옥석, 김창한, Chang. Nam-Su, Kim. Tae-Hyun, Lee. Ok-Suk, Kim. Chang-Han 저

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유한체 연산 기반의 암호시스템에서 곱셈 연산은 가장 주된 연산부로 구성된다. 또한 곱셈기 설계 환경의 자원이 제약적인 경우 비트-직렬 구조가 많이 고려된다. 본 논문은 기존의 비트-직렬 곱셈기에 비하여 작은 시간 복잡도를 가지는 삼항 기약 다항식 기반의 유한체 고속 비트-직렬 곱셈기를 제안한다. 제안하는 두 가지 타입의 곱셈기는 기존의 곱셈기에 비하여 시간 복잡도면에서는 모두 효율적이고, Interleaved 곱셈기의 $m{cdot}MUL+2m{cdot}ADD$ 시간지연 보다 작은 $(m+1){cdot}MUL+(m+1){cdot}ADD$ 시간 지연만으로 수행이...
225.

그룹 곱셈 계수를 위한 Modified CSD 그룹 곱셈기 디자인

김용은, 허일남, 정진균, Kim. Yong-Eun, Xu. Yi-Nan, Chung. Jin-Gyun 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 6 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2007, Vol.44 No.9 48-53 (6 pages)

김용은, 허일남, 정진균, Kim. Yong-Eun, Xu. Yi-Nan, Chung. Jin-Gyun 저

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Fast Fourier Transform(FFT)과 같은 디지털 신호처리 응용에서는 계수가 미리 정해진 특정 그룹의 곱셈기를 사용한다. 본 논문에서는 수정된 CSD 알고리즘 및 부분곱 공유 알고리즘을 기반으로 계수가 미리 정해진 특정 그룹의 곱셈 계수를 위한 효율적인 곱셈기 설계 방법을 제안한다. 제안한 알고리즘을 direct digital frequency synthesizer(DDFS)에 사용되는 sine/cosine 생성회로 및 128 point radix-24 FFT에 사용되는 곱셈기에 적용하였을 경우 기존 곱셈에 비하여 면적, 소비전력, 속도에서 최대 34%의 이득이 있음을 CAD...
226.

$GF(2^m)$에서 삼항 기약 다항식을 이용한 약한 쌍대 기저 기반의 효율적인 지수승기

김희석, 장남수, 임종인, 김창한, Kim. Hee-Seok, Chang. Nam-Su, Lim. Jong-In, Kim. Chang-Han 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2007, Vol.44 No.8 30-37 (8 pages)

김희석, 장남수, 임종인, 김창한, Kim. Hee-Seok, Chang. Nam-Su, Lim. Jong-In, Kim. Chang-Han 저

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본 논문에서는 기존의 다항식 기저에서 Right-to-Left 이진 방법으로 구성되었던 다항식의 지수승기를 약한 쌍대 기저 기반에서 삼항 기약다항식을 이용한 Left-to-Right 이진 형태로 구성한다. 제안하는 방법은 Left-to-Right는 고정된 다항식을 곱한다는 점에 착안, 사전계산을 이용하여 연산량을 감소시킨다. 본 논문에서 제안하는 방법은 제곱기(squarer)와 곱셈기(multiplier)를 모두 수행하는 시간이 기존 지수승기의 곱셈기의 연산 시간보다 같거나 작아 Left-to-Right 형태와 Right-to-Left 형태의 기존 지수승기보다 각각 기약...
227.

UHF 대역 수동형 RFID 태그 쇼트키 다이오드 특성 분석 및 전압체배기 설계

이종욱, 트란난, Lee. Jong-Wook, Tran. Nham 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 7 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2007, Vol.44 No.7 9-15 (7 pages)

이종욱, 트란난, Lee. Jong-Wook, Tran. Nham 저

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본 논문에서는 UHF 대역 수동 RFID 태그(UHF-band passive RFID tag) 칩 제작에 필수적인 요소인 쇼트키(Schottky) 다이오드를 CMOS 공정으로 제작하고 크기에 따른 특성을 분석하였으며 이를 이용하여 전압체배기를 설계하였다. 쇼트키 다이오드는 Titanium-Silicon 접합을 이용하여 제작되었으며, $4{ imes}10{ imes}10;{mu}m^{2}$의 면적을 가지는 쇼트키 다이오드는 $20;{mu}A$의 전류 구동에 대해 약 0.15 V의 순방향 전압 강하의 우수한 특성을 나타내었다. 역방향 파괴전압(breakdown)은 약 -9 V로 수동 RFID 태그칩의...
228.

수동형 RFID 태그를 위한 전파 이중 경로 전압 체배기

조정현, 김학수, 김시호, Cho. Jung-Hyun, Kim. Hak-Su, Kim. Shi-Ho 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 6 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2007, Vol.44 No.1 16-21 (6 pages)

조정현, 김학수, 김시호, Cho. Jung-Hyun, Kim. Hak-Su, Kim. Shi-Ho 저

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본 논문은 기존의 전압 체배기를 개선하여, 전압발생 효율과 전류 구동능력을 향상시킨 이중 경로 전파 전압 체배기를 제안하고 제작하여 특성을 측정하였다. 제안된 회로는 종래의 회로에 비하여 4개의 다이오드가 추가로 필요하나, 이로 인한 면적증가는 무시할 수 있는 수준이다. 시뮬레이션 결과에 의하면, 제안된 회로의 출력 전력은 종래회로에 비하여 약 2배 정도 향상되었다. 제작된 칩의 측정결과로부터 제안된 회로의 전압이득은 부하전류를 구동하지 않는 조건에서, 종래 회로보다 약 51% 정도 향상되었다. 제안된 회로는 UHF...
229.

System-On-Panel을 위한 다치 논리 곱셈기 설계

홍문표, 정주영, Hong. Moon-Pyo, Jeong. Ju-Young 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 9 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2007, Vol.44 No.2 104-112 (9 pages)

홍문표, 정주영, Hong. Moon-Pyo, Jeong. Ju-Young 저

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본 논문에서는 저온 다결정 실리콘 공정에서 얻어지는 박막트랜지스터를 이용하여 $7{ imes}7$ 병렬처리 곱셈기를 설계하였다. 7개의 부분곱은 Folding 회로를 기본으로 설계된 다치 논리 회로(7-3 Compressor)와 3-2 Compressor를 통해 2비트로 출력되어 Carry Propagating Adder로 전달되는 구조를 통해 Carry전달 지연을 최소화하여 연산속도를 향상시켰다. 그리고 전류모드로 동작하는 곱셈기에서 사용되는 전류원을 부분적으로 차단함으로써 전력소모를 감소시켰다. HSPICE 시뮬레이션 과정을 통해 제안된 곱셈기는 Wallace Tree...
230.

130nm 이하의 초미세 공정을 위한 저전력 32비트$ imes$32비트 곱셈기 설계

장용주, 이성수, Jang. Yong-Ju, Lee. Seong-Soo 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 6 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2006, Vol.43 No.6 47-52 (6 pages)

장용주, 이성수, Jang. Yong-Ju, Lee. Seong-Soo 저

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본 논문에서는 130nm 이하의 초미세 공정을 위한 저전력 32비트$ imes$32비트 곱셈기를 제안한다. 공정이 미세화 되어감에 따라 누설 전류에 의한 정적 전력이 급격하게 증가하여 동적 전력에 비해 무시하지 못할 수준에까지 이르게 된다. 최근 들어 동적 전력과 정적 전력을 동시에 줄일 수 있는 방법으로 MTCMOS에 기반하는 전원 차단 방법이 널리 쓰이고 있지만, 대규모 블록의 전원이 복귀될 때 심각한 전원 잡음이 발생하는 단점이 있다. 따라서 제안하는 곱셈기는 파이프라인 스테이지를 따라 순차적으로 전원을 차단하고...

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