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241.

시스템 복잡도를 개선한 $GF(2^m)$ 상의 병렬 $AB^2+C$ 연산기 설계

변기령, 김흥수 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 7 Pages

대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SC, 시스템 및 제어 2003, Vol.40 No.6 24-30 (7 pages)

변기령, 김흥수 저

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본 논문에서는 m차 기약 AOP를 적용하여 시스템 복잡도를 개선한 GF(2m)상의 새로운 AB²＋C 연산기법과 그 하드웨어 구현회로를 제안하였다. 제안된 회로는 병렬 입출력 구조를 가지며, CS, PP 및 MS를 모듈로 하여 구성되며 이들은 각각 AND와 XOR 게이트의 규칙적인 배열구조를 갖는다. 제안된 회로의 시스템 복잡도는 (m＋1)²개의 2-입력 AND게이트와 (m＋1)(m＋2)개의 2-입력 XOR게이트의 회로복잡도와 연산에 소요되는 최대 지연시간은 TA＋^{(1＋「log₂m」)Tx 이다. 제안된 연산기의 시스템 복잡도와 구성상의 특징을 타...}
242.

현대전 $C^3$I 역할

이상철, 김영기.이성우 대한전자공학회 電子工學會誌 12 Pages

대한전자공학회 電子工學會誌 1988, Vol.15 No.1 72-83 (12 pages)

이상철, 김영기.이성우 저

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본문에서는 현대전에 있어서 군전력의 핵심이 되는 지휘. 통제, 통신 및 정보(C3I)체계에 대하여 논의코자 한다. 먼저 C3I에 대한 이해를 돕기 위하여 C3I 체계의 기능과 계층별 구조 및 그 운용 개념등을 설명하였다. 우리나라의 C3I체계 구현을 위해서 선진국의 C3I체계 개발 현황을 소개하였고 소요 핵심 기술과 특히 연구 개발자를 위한 군요구 정의 방안을 제시하였다. 끝으로 체계 개발을 위한 점진적 개선 방안을 건의 하였고 군 전력 승수(force multiplier)로써의 C3I 역할을 설명하였다.
243.

제한된 범위의 Signed-Digit Number 인코딩을 이용한 병렬 십진 곱셈기 설계

황인국, 김강희, 윤완오, 최상방, Hwang. In-Guk, Kim. Kanghee, Yoon. WanOh, Choi. SangBang 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 9 Pages

대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2013, Vol.50 No.3 50-58 (9 pages)

황인국, 김강희, 윤완오, 최상방, Hwang. In-Guk, Kim. Kanghee, Yoon. WanOh, Choi. SangBang 저

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본 논문에서는 제한된 범위의 Signed-Digit number 인코딩과 축약 단계를 이용한 고정소수점 병렬 십진 곱셈기를 제안한다. 제안한 병렬 십진 곱셈기는 승수와 피승수를 제한된 범위의 SD number로 인코딩하여 캐리 전달 지연 없이 빠르게 부분곱을 생성한다. 인코딩에 사용하는 숫자의 범위를 줄임으로써 SD number 다중 피연산자 덧셈의 한번에 연산 가능한 피연산자의 개수가 늘어나게 되고, 이에 따라 부분곱 축약 단계의 연산을 빠르게 수행 할 수 있다. 제안한 병렬 십진 곱셈기의 성능 평가를 위해 Design Compiler에서 SMIC사의...
244.

Sigma Delta Decimation Filter Design for High Resolution Audio Based on Low Power Techniques

휸 하이 아우, 김소영, Au. Huynh Hai, Kim. SoYoung 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 8 Pages

대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2012, Vol.49 No.11 141-148 (8 pages)

휸 하이 아우, 김소영, Au. Huynh Hai, Kim. SoYoung 저

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논문은 sigma-delta ADC에 사용될 수 있는 저전력 4 단 32 bit 데시메이터 필터 디자인을 제안한다. 디지털 데시메이션 필터는 CIC(cascaded integrator-comb) filter와 세 개의 half-band FIR filter로 이루어져 있다. 전력소모를 최소화하기 위하여 CIC filter에는 pipeline구조가 사용되었고, FIR 필터의 multiplier 구조를 최적화하기 위하여 Canonic Signed Digit (CSD) 코드가 사용되었다. 130nm CMOS 공정으로 설계 자동화 CAD 도구를 사용하여 타이밍, 면적, 전력소모를 최적화하여 98.304 MHz 주파수에서 697 uW의 전력을...
245.

듀얼기저에 기초한 효율적인 곱셈기 설계

박춘명, Park. Chun-Myoung 대한전자공학회 Journal of the Institute of Electronics and Information Engineers 7 Pages

대한전자공학회 Journal of the Institute of Electronics and Information Engineers 2014, Vol.51 No.6 117-123 (7 pages)

박춘명, Park. Chun-Myoung 저

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본 논문에서는 기저변환을 사용하여 효율적인 곱셈기를 구성하는 방법을 제안하였다. 제안한 곱셈기는 두 입력부분 중 한 입력을 듀얼기저로 변환하는 표준-듀얼 기저 변환회로 모듈과 주어진 m차 기약다항식에 의해 $b_m$부터 $b_{m+k}$를 발생시키는 $b_{m+k}$차 발생연산모듈, $m^2$개의 AND 게이트와 m(m-1)개의 EX-OR 게이트로 구성되는 다항식 승산모듈로 구성된다. 또한, 듀얼기저로 표현되는 출력부분을 표준기저로 변화시켜주는 듀얼-표준 기저 변환회로 모듈로 구성되며, 각 연산부의 구성에 필요한 기본 연산모듈을...
246.

역률 개선 제어용 집적회로의 설계

이준성, Lee. Jun-Sung 대한전자공학회 Journal of the Institute of Electronics and Information Engineers 7 Pages

대한전자공학회 Journal of the Institute of Electronics and Information Engineers 2014, Vol.51 No.5 219-225 (7 pages)

이준성, Lee. Jun-Sung 저

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전류 파형의 불균형 등과도 관련이 있다. 설계된 본 회로는 부하에 공급되는 교류전력의 전류 파형은 전압파형과 위상차가 적으면서 정현파에 가깝게 공급하는 기능을 제공한다. 자체 발진하는 10[kHz]~100[kHz] 내외의 주파수로 AC 전원에 연결된 코일을 스위칭 한 후 코일전류를 부하에 공급하는 기능을 위한 회로, AC 파형의 zero crossing 지점을 찾는 기능을 함께 수행하는 multiplier 회로, UVLO, OVP, BGR 등의 회로를 한 개의 IC에 집적할 수 있도록 설계하였다. 제작공정은 최소선폭 $0.5[{mu}m]$, 내압 20[V], 2P_2M CMOS...
247.

A Novel Approach for the Unit Commitment with Vehicle-to-grid

Jin. Lei, Yang. Huan, Zhou. Yuying, Zhao. Rongxiang 대한전기학회 분과 Journal of international Conference on Electrical Machines and Systems 8 Pages

대한전기학회 분과 Journal of international Conference on Electrical Machines and Systems 2013, Vol.2 No.3 367-374 (8 pages)

Jin. Lei, Yang. Huan, Zhou. Yuying, Zhao. Rongxiang 저

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248.

IMS T-800 트랜스퓨터 아키텍쳐

황희융, 최정훈 대한전기학회 전기학회지= The Processing of the Institute of Electrical Engineers 15 Pages

대한전기학회 전기학회지= The Processing of the Institute of Electrical Engineers 1988, Vol.37 No.8 30-44 (15 pages)

황희융, 최정훈 저

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언어 2. 본론 (IMS T800 트랜스퓨터) 2-1. IMS T800 아키텍쳐 IMS T414 2-2. 리버모어 루프(The Livermore Loop) - 스택 이용도의 최적화, FPU와 CPU의 병행 연산 (concurrency) 2-3. 부동점 연산부 디자인(FPU design) - multiplier, 표준함수의 계산 2-4. 부동점 연산 성능(Floating Point Performance) 2-5. Formal specification language - 정확하고 빠른 디자인을 위한 시스템 기술 언어, Formal specification language Z 2-6. 통신 링크(communication link) 2-7. 그래필 능력(Graphic capability) - Move 2d, Draw 2d, and Clip...
249.

승산기용 linear-to-log

김병운 대한전기학회 전기학회지= The Processing of the Institute of Electrical Engineers 3 Pages

대한전기학회 전기학회지= The Processing of the Institute of Electrical Engineers 1962, Vol.9 No.8 1-3 (3 pages)

김병운 저

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본고에서는 앞으로의 주된 연구과제인 원자로 Simulator로 쓰일 Repetitive형 Analog계산기의 multiplier용으로 사용하기 위하여, 간단하면서도 조정이 쉬우며 안정도와 신뢰도가 큰 삼극관을 사용한 Convertor 회로를 택하여 이를 실험 검토하는 한편 출력측의 cathode-follower진공관을 5751로 개변하여 우리 실정에 정합토록하였다. 즉 이렇게 하므로서 불필요한 소모전류를 절약하며 충분히 낮은 출력 impedance을 얻을 수 있고 또한 얻기에 용이하고 염가한 진공관을 사용하면서도 훌륭한 특성을 얻을 수 있다.
250.

밀리미터파 대역 제2고조파 고효율 생성을 위한 부하 임피던스의 최적화 방법

최영규, Choi. Young-Kyu 대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 6 Pages

대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 2011, Vol.60 No.8 1566-1571 (6 pages)

최영규, Choi. Young-Kyu 저

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