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5㎓대역 OFDM 무선 LAM 모뎀 설계 및 FPGA 구현
문대철, 홍성협, Moon. Dai-Tchul, Hong. Seong-Hyub 한국신호처리시스템학회 信號處理·시스템學會 論文誌 5 Pages
한국신호처리시스템학회 信號處理·시스템學會 論文誌 2004, Vol.5 No.4 333-337 (5 pages)
송 수신부 모뎀을 설계하고 FPGA로 실현하였다. 고속 데이터 전송시 발생하는 심벌간 간섭(ISI)을 제거하기 위하여 Normalized LMS 알고리듬을 적용한 단일탬 등화기를 사용하여 제거하였고, 또한 반송파 주파수 옵셋 알고리듬을 이용하여 채널간 간섭(ICI)을 제거하였다. 송ㆍ수신기간의 전송은 에러없이 정확히 전송되어짐을 시뮬레이션을 통하여 입증하였으며, 또한 타이밍 시뮬레이션 결과 최대 동작주파수는 20.3MHz로 IEEE 802.11a 무선 LAN 방식의 동작속도를 만족하였다. 그리고 설계시 DSP와 EMB(Embedded Memory Block)블록을... -
SDH와 SONET망의 동기화를 위한 포인터 해석기의 FPGA 구현
이상훈, 박남천, 신위재 한국신호처리시스템학회 信號處理·시스템學會 論文誌 6 Pages
한국신호처리시스템학회 信號處理·시스템學會 論文誌 2004, Vol.5 No.3 230-235 (6 pages)
논문에서는 동기식 광전송망인 SDH와 SONET망의 동기화를 위해 적용되는 포인터 해석기의 FPGA 구현을 다룬다. 설계된 포인터 해석기는 포인터 추출 모듈과 포인터 해석 모듈로 구성된다. 포인터 추출 모듈은 6480진 카운터, 시프트레지스터, 포인터 워드 동기화 블록으로 구성되며, 51.84 Mb/s AU-3/STS-1 프레임 데이터에서 프레임 동기신호에 의해 H1, H2 포인터 워드 값을 찾고 이를 8 분주하여 바이트 레벨의 6.48 Mb/s로 동기화 시킨다. 포인터 해석 모듈은 majority vote, 포인터 워드 유ㆍ무효 검사, 포인터 정렬판단, NORM, AIS,... -
FPGA를 이용한 JPEG Image Display Board 설계 및 구현
권병헌, 서범석, Kwon. Byong-Heon, Seo. Burm-Suk 한국디지털콘텐츠학회 디지털콘텐츠학회 논문지 6 Pages
한국디지털콘텐츠학회 디지털콘텐츠학회 논문지 2005, Vol.6 No.3 169-174 (6 pages)
본 논문은 Verilog HDL로 FPGA에 JPEG Decoder를 구현하여 TV에 JPEG 영상을 디스플레이 하기 위한 JPEG Image Display Board 설계 방법을 제안한다. 본 논문은 FPGA에 Decoder Algorithm을 구현하기 위한 효율적인 방안을 제시하였으며 JPEG Decoder Algorithm은 JPEG Standard Baseline에 기준으로 하여 설계 하였다. 압축된 JPEG bit stream을 저장하기 위하여 Nand Flash Memory를 사용하였으며, JPEG Decoding된 영상을 TV화면에서 확인하기 위하여 Video Encoder를 사용하였다. 또 한 JPEG 영상에 Text data를 쓰기 위하여 YCbCr의... -
The Analysis and Implementation of DVB-S2 BC mode ystem
이인기, 장대익, Lee. In-Ki, Chang. Dae-Ig 통신위성우주산업연구회 통신위성우주산업연구회논문지 5 Pages
통신위성우주산업연구회 통신위성우주산업연구회논문지 2008, Vol.3 No.2 38-42 (5 pages)
수신되어야 한다. 이를 위해서 방송사업자는 기존의 DVB-S 수신기에는 DVB-S 신호를, DVB-S2 수신기에는 DVB-S2 신호를 전송해야 한다. DVB-S2 수신기에서 DVB-S서비스를 수용하기 위해서는 DVB-S2 chip에 DVB-S 모듈이 구현되어야 한다. 이런 역호환성을 위해서 시스템에서는 계층적 변조 방식을 적용해야 하며, 시스템 마진을 만족하기 위해 본 논문에서는 편향각에 따른 시스템의 성능을 분석하였으며 또한 성능을 검증해 보았다. 그리고 본 방식을 검증하기 위해서 FPGA chip을 이용하여 테스트베드를 구현하였으며 이를 보인다. -
위성체용 2비트 오류검출 및 1비트 정정 FPGA 구현
노영환, 이상용, No. Yeong-Hwan, Lee. Sang-Yong 제어로봇시스템학회 제어·자동화·시스템공학 논문지 6 Pages
제어로봇시스템학회 제어·자동화·시스템공학 논문지 2000, Vol.6 No.2 228-233 (6 pages)
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FPGA를 이용한 유도 전동기의 디지털 전류 제어 시스템 구현
양오 대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 10 Pages
대한전자공학회 電子工學會論文誌. Journal of the Korean Institute of Telematics and Electronics. C 1998, No.0 21-30 (10 pages)
소프트웨어적으로 가변 하도록 하였다. 이와 같은 기능들을 FPGA로 구현하기 위하여 퀵로직(Quick Logic)사의 pASIC 2 SpDE와 Synplify-Lite 합성툴을 이용하여 로직을 합성하였다. 또한 Verilog HDL 환경에서 최악의 상황들(worst cases)에 대한 최종 시뮬레이션이 성공적으로 수행되었다. 아울러 구현된 FPGA를 84핀 PLCC 형태의 FPGA로 프로그래밍 한 후 3상 유도전동기의 디지털 전류 제어 시스템에 적용하였다. 이를 위해 DSP(TMS320C31-40 MHz)와 FPGA, A/D 변환기 및 전류 변환기(Hall CT) 등을 이용하여 3상 유도 전동기의 디지털... -
Design and Implementation of DSP-based Satellite Modem Unit
Cho. Yong-Hoon, Ahn. Jae-Young, Kim. Won-Ho 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TE, 전문기술교육 10 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TE, 전문기술교육 2000, Vol.37 No.5 93-102 (10 pages)
위성통신 시스템의 디지털 모뎀의 기능 및 성능 규격들을 제시하고, 제시한 규격을 만족하는 위성모뎀의 구조 설계 및 구현에 대하여 기술한다. 다양하면서 융통성이 요구되는 위성모뎀의 규격들을 만족시키기 위하여 디지털 신호 처리기(DSP)와 프로그래머블 게이트 어레이(FPGA)를 기반으로 하여 설계 및 구현되었다. 구현된 위성모뎀은 DAMA-SCPC 위성통신 시스템에 통합하여 수행한 시험에서 안정된 동작과 제시된 기능 및 성능 규격을 모두 만족함을 검증하였다. 연속모드(at Eb/No=4.7, FEC=3/4) 에서 측정된 BER은 약 1×10E-4의...