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회전 변환 정사각 신호 성좌에 적용한 낮은 PAPR의 CIOD 전송방식
김창중, 이호경, Kim. Chang-Joong, Lee. Ho-Kyoung 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 5 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 2012, Vol.49 No.8 65-69 (5 pages)
회전 변환된 정사각 QAM 신호 성좌를 클리핑하여 좌표 축 인터리브 된 직교 설계(Coordinate Interleaved Orthogonal Design; CIOD)에 적용되는 낮은 최대 전력 대비 평균 전력 비(Peak-to-Average-Power Ratio; PAPR)을 가지는 신호 성좌를 설계한다. 본 논문에서 제안하는 신호 성좌는 기존의 회전 변환된 정사각 QAM 신호 성좌에 비해 매우 낮은 PAPR을 가질 뿐 아니라, 기존의 신호 성좌와 거의 동일한 비트 오율(Bit Error Rate; BER) 성능을 가진다. -
EPON에서 하향 데이터 전송을 고려한 동적 대역폭 할당 방안
김은철, 이강원, 최영수, 조유제, Kim. Eun-Chul, Lee. Kang-Won, Choi. Young-Soo, Cho. You-Ze 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 8 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 2005, Vol.42 No.12 37-44 (8 pages)
부하가 낮은 환경에서는 폴링 오버헤드에 의한 하향 채널의 대역폭 낭비가 심한 문제점이 있다. 본 논문에서는 Ethernet passive optical network(EPON)에서 가변 폴링 주기와 고정 폴링 주기 방안의 장점만을 취한 새로운 동적 대역폭 할당 방안을 제안한다. 제안한 방안은 대표적인 가변 폴링 주기 방안인 interleaved polling with adaptive cycle time(IPACT) 방안에 기반을 두고, 하향전송을 위한 optical line terminal(OLT) 큐의 상태에 따라 가변 폴링 주기 혹은 고정 폴링 주기로 동작한다. 시뮬레이션을 통해 제안 방안은 상향... -
Ethernet PON에서 가입자간 가중치 공평성을 보장하는 매체접근 제어 알고리즘의 설계 및 성능 분석
최은영, 이재용, 김병철, 권영미 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 9 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. TC, 통신 2004, Vol.41 No.8 45-53 (9 pages)
Interleaved Polling with Deficit Round Robin)을 제안하고 성능 분석을 하였다. 제안된 IPDRR 기법의 목적은 기존 Ethernet PON의 TDMA나 Interleaved Polling with Adaptive Cycle Time (IPACT) 방식에서 전송하려는 프레임의 크기가 자신에게 할당된 슬롯의 잔여 대역을 초과하는 경우 이러한 대역폭을 사용하지 못하게 되어 낭비되던 잔여 대역폭을 줄이고, 각 ONU별로 서비스 받는 트래픽 대역폭을 가중치에 비례해서 제공함으로써 각각의 ONU에게 공평성을 보장하는 것이다. 본 논문에서는 시뮬레이션을 통해 기존 Ethernet PON의... -
고속 비트-직렬 유한체 곱셈기
장남수, 김태현, 이옥석, 김창한, Chang. Nam-Su, Kim. Tae-Hyun, Lee. Ok-Suk, Kim. Chang-Han 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 6 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2008, Vol.45 No.2 49-54 (6 pages)
환경의 자원이 제약적인 경우 비트-직렬 구조가 많이 고려된다. 본 논문은 기존의 비트-직렬 곱셈기에 비하여 작은 시간 복잡도를 가지는 삼항 기약 다항식 기반의 유한체 고속 비트-직렬 곱셈기를 제안한다. 제안하는 두 가지 타입의 곱셈기는 기존의 곱셈기에 비하여 시간 복잡도면에서는 모두 효율적이고, Interleaved 곱셈기의 $m{cdot}MUL+2m{cdot}ADD$ 시간지연 보다 작은 $(m+1){cdot}MUL+(m+1){cdot}ADD$ 시간 지연만으로 수행이 가능하다. 따라서 확장체의 표수가 작은 타원곡선 암호 시스템, 페어링 기반의 암호시스템에서 고속... -
고속 페이징 시스템을 위한 FLEX 프로토콜 신호처리기의 구현
강민섭, 이태응, Gang. Min-Seop, Lee. Tae-Eung 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 10 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2001, Vol.38 No.1 69-78 (10 pages)
논문에서는 A/D 변환기의 입력 단에서 수신된 interleaved 4-level 비트 심볼 데이터의 동기를 위한 심볼 동기 알고리듬과 (31,21)BCH 부호에 대해 실시간 2중 오류정정이 가능한 개선된 복호 알고리듬을 제안한다. 설계된 프로토콜 신호처리기는 6개의 기능 모듈로 구성되어 있으며, 각 모듈은 VHDL(VHSIC Hardware Description Language)로 모델링을 행하였다. 제안된 프로토콜 신호기는 Axil-320 워크스테이션 상에서 SynopsysTM툴을 이용하여 기능 시뮬레이션 및 논리합성(Altera 10K 라이브러리 이용)을 수행하였다. 논리합성 결과... -
채널 등화기를 내장한 2.0GS/s 5비트 전류 모드 ADC 기반 수신기
문종호, 정우철, 김진태, 권기원, 전영현, 전정훈, Moon. Jong-Ho, Jung. Woo-Chul, Kim. Jin-Tae, Kwon. Kee-Won, Jun. Young-Hyun, Chun. Jung-Hoon 대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 10 Pages
대한전자공학회 Journal of the Institute of Electronics Engineers of Korea 2012, Vol.49 No.12 184-193 (10 pages)
수 있는 5비트 2.0GS/s 2-way time interleaved 파이프라인 ADC 기반의 수신기를 소개한다. 샘플링 주파수를 높이기 위해, ADC 각 단은 트랙킹과 증폭이 동시에 수행되는 전류 모드 구조를 사용하였다. 또한 ADC 각단에 1-tap FIR 등화기를 탑재하여 별도의 디지털 후처리 없이 채널의 ISI를 감소시켰다. 제안한 수신기는 110nm 공정을 사용하여 설계하였다. 메모리를 제외한 수신기는 $0.58{ imes}0.42mm^2$의 크기를 갖고, 동작전압 1.2V에서 91mW의 전력을 소모한다. 시뮬레이션 결과 2.0GS/s 샘플링 주파수에서 20MHz의 입력 주파수와... -
시간 선택적 페이딩 환경에서 CIOD 시공간 블록 부호의 성능 분석
문승현, 이호경, Moon. Seung-Hyun, Lee. Ho-Kyoung 대한전자공학회 Journal of the Institute of Electronics and Information Engineers 7 Pages
대한전자공학회 Journal of the Institute of Electronics and Information Engineers 2014, Vol.51 No.6 43-49 (7 pages)
신호로 디자인(Coordinate interleaved orthogonal design: CIOD)된 시 공간 블록 부호(Space time block code: STBC)가 시간 선택적 페이딩 채널인 1차 Markov 채널을 통과하였을 때에 성능 분석을 다룬다. 채널이 준 정지 페이딩 채널(Quasi-static fading channel)일 경우 STBC-CIOD는 최대 전송률과 최대 다이버시티(Full rate full diversity: FRFD)를 만족하고, 단일 심볼 복호가 가능한(single symbol decodable: SSD) 코드이나, 시간 선택적 페이딩 환경에서는 신호간의 간섭이 생기므로 FRFD을 만족시키더라도 단일 심볼 복호를... -
Parallel Operation of Trans-Z-Source Network Full-Bridge DC-DC Converter for Wide Input Voltage Range
Lee. Hyeong-Min, Kim. Heung-Geun, Cha. Hon-Nyong 대한전기학회 분과 Journal of international Conference on Electrical Machines and Systems 7 Pages
대한전기학회 분과 Journal of international Conference on Electrical Machines and Systems 2012, Vol.1 No.2 98-104 (7 pages)
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EMTP를 이용한 직류배전계통 연계용 양방향 DC/DC 컨버터 모델링
한준, 김두웅, 오윤식, 권기현, 노철호, 정택현, 김철환, Han. Joon, Kim. Doo-Ung, Oh. Yun-Sik, Gwon. Gi-Hyeon, Noh. Chul-Ho, Jung. Tack-Hyun, Kim. Chul-Hwan 대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 7 Pages
대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 2014, Vol.63 No.5 615-621 (7 pages)
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전류게인 전향보상기법을 이용한 부스트 컨버터의 불연속전도 모드 전류제어
이승구, 김영록, 차한주, Lee. Seung-Goo, Kim. Young-Roc, Cha. Han-Ju 대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 7 Pages
대한전기학회 전기학회논문지= The Transactions of the Korean Institute of Electrical Engineers 2011, Vol.60 No.11 2049-2055 (7 pages)


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