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New Efficient Design of Reed-Solomon Encoder, Which has Arbitrary Parity Positions, without Galois Field Multiplier
안형근, An. Hyeong-Keon 한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 네트워크 및 서비스 7 Pages
한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 네트워크 및 서비스 2010, Vol.35 984-990 (7 pages)
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3치 Rate Multiplier의 설계
황인호, 심수보 한국통신학회 한국통신학회논문지 6 Pages
한국통신학회 한국통신학회논문지 1981, Vol.6 No.1 32-37 (6 pages)
本 論文에서는 3値 Rate Multipher에 對한 設計法을 硏究하였다. 이미 發表된 3値 計數器를 利用하는 方法보다 高速으로 動作할 수 있는 새로운 設計法. 즉 Shift Resister를 利用하여 Rate Multiplier를 構成하는 方法을 提案하고 前者의 方法과 比較 設計하였다. 이 設計法에 依한 回路構成은 3値 Inverter를 除外하고는 Binary 素子를 그대로 쓸 수 있게 한 점이 特徵이며, 集積化하는 過程에서도 現在의 IC 設計方法에 可能의 支障을 주지 않는다. -
A Study on the Edge Enhancement of X-ray Images Generated by a Gas Electron Multiplier Chamber
Moon. B.S., Coster. Dan 한국지능시스템학회 International journal of fuzzy logic and intelligent systems 6 Pages
한국지능시스템학회 International journal of fuzzy logic and intelligent systems 2004, Vol.4 No.2 155-160 (6 pages)
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New High Speed Parallel Multiplier for Real Time Multimedia Systems
조병록, 이명옥, Cho. Byung-Lok, Lee. Mike-Myung-Ok 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 6 Pages
한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part A. Part A 2003, No.0 671-676 (6 pages)
본 논문에서는 고속 병렬 곱셈기에서 속도향상을 위해 부분 곱을 가산하는 과정에 구성되는 CSA(Carry Select Adder) 트리에 새로운 압축기를 적용한 새로운 첫 번째 부분 곱가산(First Partial Product Addition : FPA)를 제안하여 기존의 전가산기를 이용한 병렬가산기보다 부분곱을 계산하는 속도를 약 20% 개선할 수 있게 했다. 새로운 회로는 새로운 FPA 구조를 사용하여 최종 합 CLA 비트를 N/2로 줄인다. 2.5v 0.25um CMOS 기술을 이용하여 제작된 16${ imes}$16 곱셈기는 5.14nS의 곱셈 고속을 얻었다. 이 곱셈기의 구조는... -
Rectifier Design Using Distributed Greinacher Voltage Multiplier for High Frequency Wireless Power Transmission
Park. Joonwoo, Kim. Youngsub, Yoon. Young Joong, So. Joonho, Shin. Jinwoo 한국전자파학회 Journal of electromagnetic engineering and science : JEES 6 Pages
한국전자파학회 Journal of electromagnetic engineering and science : JEES 2014, Vol.14 No.1 25-30 (6 pages)