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IP 어드레스 검색을 위한 새로운 pipelined binary 검색 구조
임혜숙, 이보미, 정여진, Lim. Hye-Sook, Lee. Bo-Mi, Jung. Yeo-Jin 한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 네트워크 및 서비스 11 Pages
한국통신학회 한국통신학회논문지. The Journal of Korea Information and Communications Society. 네트워크 및 서비스 2004, Vol.29 18-28 (11 pages)
제안한다. 제안된 구조는 (1)에서 제안된 binary tree의 문제점들을 해결하는 구조로서 작은 수의 엔트리를 갖는 TCAM과 pipelined binary search를 적용하여 효율적인 하드웨어로 구현되었다. 구현된 하드웨어 구조의 성능을 평가하여 본 결과., 약 30,000 여개의 entry를 갖는 MAE-WEST 라우터 데이타의 경우, 2,000여개의 엔트리를 갖는 TCAM과 총 245 Kbyte의 SRAM을 사용하여 한번의 메모리 access를 통하여 어드레스 검색이 가능한 것으로 평가되었다. 또한 제한된 방식은 큰 데이터베이스나 IPv6를 위해서도 확장이 용이하다. -
A 1.8 V 40-MS/sec 10-bit 0.18-㎛ CMOS Pipelined ADC using a Bootstrapped Switch with Constant Resistance
Eo. Ji-Hun, Kim. Sang-Hun, Kim. Mun-Gyu, Jang. Young-Chan 한국정보통신학회 Journal of information and communication convergence engineering 6 Pages
한국정보통신학회 Journal of information and communication convergence engineering 2012, Vol.10 No.1 85-90 (6 pages)
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A Design of A Multistandard Digital Video Encoder using a Pipelined Architecture
Oh. Seung-Ho, Park. Han-Jun, Kwon. Sung-Woo, Lee. Moon-Key 한국정보과학회 Journal of electrical engineering and information science 8 Pages
한국정보과학회 Journal of electrical engineering and information science 1997, Vol.2 No.5 9-16 (8 pages)
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CMOS Clockless Wave Pipelined Adder Using Edge-Sensing Completion Detection
안용성, 강진구, Ahn. Yong-Sung, Jin-Ku. Jin-Ku 한국전기전자학회 전기전자학회논문지 5 Pages
한국전기전자학회 전기전자학회논문지 2004, Vol.8 No.2 161-165 (5 pages)
본 논문은 CMOS 에지 완료검출 신호를 이용하여 8bit 웨이브파이프라인 덧셈기를 설게하였다. 이 구조는 클럭이 필요 없이 동작한다. 에지감지후 신호완료를 검출하는 알고리즘회로는 센서회로와 래치로 구성되어있다. 제안하는 구조를 이용하여 8bit 덧셈기의 출력이 거의 같은 시간에 만들어 지도록 정렬된다. 시뮬레이션에서 0.35um CMOS 공정을 사용하여 3.3V 공급전압으로 1GHz 동작을 확인하였다. -
영상처리를 위한 Pipelined 병렬처리 시스템
이형, 김종배, 최성혁, 박종원, Lee. Hyung, Kim. Jong-Bae, Choi. Sung-Hyk, Park. Jong-Won 한국전기전자학회 전기전자학회논문지 13 Pages
한국전기전자학회 전기전자학회논문지 2000, Vol.4 No.2 212-224 (13 pages)
속도를 향상하기 위한 병렬처리 시스템을 제안한다. 병렬처리 시스템은 Pipelined SIMD 구조를 갖고 있으며, 다수개의 처리기와 다중접근 기억장치로 구성된다. 다중접근 기억장치는 메모리 모듈들과 메모리 제어부로 구성되며, 메모리 제어부는 메모리 모듈 선택 모듈, 데이터 라우팅 모듈, 그리고 주소 계산 및 라우팅 모듈로 구성되어 있으며, 블록, 행, 그리고 열 내의 데이터를 동시에 접근할 수 있는 기능을 제공한다. 제안한 병렬처리 시스템을 검증하기 위해서 형태학적 필터를 적용하여 기능 검증 및 처리속도를 확인하였다.