- 20Mbps급 64state Viterbi 복호기 구조설계 및 CPLD 구현
- ㆍ 저자명
- 정지원,김상명,김상훈,황원철
- ㆍ 간행물명
- 한국해양정보통신학회논문지
- ㆍ 권/호정보
- 1999년|3권 4호|pp.831-837 (7 pages)
- ㆍ 발행정보
- 한국해양정보통신학회
- ㆍ 파일정보
- 정기간행물| PDF텍스트
- ㆍ 주제분야
- 기타
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본 논문에서는 Viterbi 복호기의 동작을 고속화할 수 있는 구조를 제시하였고, 제시된 방식으로 설계된 Viterbi 복호기를 CPLD 칩으로 구현하였다. Altera사의 Design Compiler를 이용하여 FLEX10K 칩에 합성한 Viterbi 복호기는 최고 20[Mbps]급 전송속도를 갖고 있으며, ASIC 설계시 100Mbps 이상의 속도가 가능하므로 고속 무선멀티미디어통신 시스템의 오류정정부호로 적용될 수 있다.