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전단하중하의 반도체 칩 접착계면의 특이응력 해석
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  • 전단하중하의 반도체 칩 접착계면의 특이응력 해석
저자명
이상순
간행물명
마이크로전자 및 패키징 학회지
권/호정보
2000년|7권 4호|pp.31-35 (5 pages)
발행정보
한국마이크로전자및패키징학회
파일정보
정기간행물|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
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기타언어초록

반도체 칩과 리드프레임을 접착하고 있는 얇은 접착제층에 전단하중이 가해질 때 발생하는 응력상태를 조사하고 있다. 계면 응력상태를 해석하기 위해서 경계요소법이 사용되고 있다. 선형 탄성이론을 적용하여 해석하면, 강체와 접착제의 계면이 자유 경 계면과 만나는 부분에서 $gamma^{lambda=1}$(0<1<1) 형태의 응력 특이성이 존재한다. 이러한 특이성으로 인해, 모서리 균열이나 계면 박리가 발생할 수 있다.

기타언어초록

The stress state developed in a thin adhesive layer bonded between the semiconductor chip and the leadframe and subjected to a shear loading is investigated. The boundary element method (BEM) is employed to investigate the behavior of interface stresses. Within the context of a linear elastic theory, a stress singularity of type $gamma^{lambda=1}$(0<1<1) exists at the point where the interface between one of the rigid adherends and the adhesive layer intersects the free surface. Such singularity might lead to edge crack or delamination.