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High-speed Hardware Design for the Twofish Encryption Algorithm
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  • High-speed Hardware Design for the Twofish Encryption Algorithm
  • High-speed Hardware Design for the Twofish Encryption Algorithm
저자명
Youn. Choong-Mo,Lee. Beom-Geun
간행물명
International journal of maritime information and communication sciences
권/호정보
2005년|3권 4호|pp.201-204 (4 pages)
발행정보
한국해양정보통신학회
파일정보
정기간행물|ENG|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
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기타언어초록

Twofish is a 128-bit block cipher that accepts a variable-length key up to 256 bits. The cipher is a 16­round Feistel network with a bijective F function made up of four key-dependent 8-by-8-bit S-boxes, a fixed 4­by-4 maximum distance separable matrix over Galois Field$(GF (2^8)$, a pseudo-Hadamard transform, bitwise rotations, and a carefully designed key schedule. In this paper, the Twofish is modeled in VHDL and simulated. Hardware implementation gives much better performance than software-based approaches.