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Analysis on DIBL of DGMOSFET for Device Parameters
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  • Analysis on DIBL of DGMOSFET for Device Parameters
  • Analysis on DIBL of DGMOSFET for Device Parameters
저자명
Jung. Hak-Kee
간행물명
International journal of information and communication engineering
권/호정보
2011년|9권 6호|pp.738-742 (5 pages)
발행정보
한국정보통신학회
파일정보
정기간행물|ENG|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
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기타언어초록

This paper has studied drain induced barrier lowering(DIBL) for Double Gate MOSFET(DGMOSFET) using analytical potential model. Two dimensional analytical potential model has been presented for symmetrical DGMOSFETs with process parameters. DIBL is very important short channel effects(SCEs) for nano structures since drain voltage has influenced on source potential distribution due to reduction of channel length. DIBL has to be small with decrease of channel length, but it increases with decrease of channel length due to SCEs. This potential model is used to obtain the change of DIBL for DGMOSFET correlated to channel doping profiles. Also device parameters including channel length, channel thickness, gate oxide thickness and doping intensity have been used to analyze DIBL.