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Implementation of an AMBA-Based IP for H.264 Transform and Quantization
이선영, 조경순, Lee. Seon-Young, Cho. Kyeong-Soon 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2006, Vol.43 No.10 126-133 (8 pages)
필요로 하는 순방향 및 역방향 변환과 양자화를 수행할 수 있는 AMBA 기반 IP에 대해서 기술하고 있다. 변환과 양자화 회로는 면적과 성능 측면에서 최적화되어 있으며, AMBA를 기반으로 동작하기 위해서 AHB 랩퍼 회로가 추가되었다. IP가 버스를 점유하는 시간과 비디오 데이터를 외부 메모리의 어느 위치에 저장할 것인지를 사용자가 지정할 수 있도록 설계하였다. Xilinx FPGA와 ARM9 프로세서를 장착한 플랫폼 보드를 사용하여 제안된 IP가 AMBA 표준에 근거하여 동작하는지를 검증하였다. $0.25{mu}m$ 표준 셀을 사용하여 이 회로를... -
Implementation of WLAN Baseband Processor Based on Space-Frequency OFDM Transmit Diversity Scheme
정윤호, 노승표, 윤홍일, 김재석, Jung. Yunho, Noh. Seungpyo, Yoon. Hongil, Kim. Jaeseok 대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 8 Pages
대한전자공학회 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체 2005, Vol.42 No.5 55-62 (8 pages)
전송률의 $80\%$를 목표 throughput으로 설정 했을 때, SF-OFDM 기반 무선 LAN 시스템은 기존의 IEEE 802.11a 무선 LAN 시스템에 비해 약 5.95 dB의 SNR 이득과 3.98 미터의 coverage 이득을 얻을 수 있었다. 제안된 알고리즘이 적용된 SF-OFDM 무선 LAN 기저대역 프로세서는 하드웨어 설계 언어를 통해 설계되었으며, 0.18um 1.8V CMOS 표준 셀 라이브러리를 통해 합성되었다. 제시된 division-free 하드웨어 구조와 함께, 구현된 프로세서의 총 게이트 수는 약 945K개였으며, FPGA 테스트 시스템을 통해 실시간 검증 및 평가되었다. -
Depth-adaptive Sharpness Adjustments for Stereoscopic Perception Improvement and Hardware Implementation
Kim. Hak Gu, Kang. Jin Ku, Song. Byung Cheol 대한전자공학회 IEIE Transactions on Smart Processing and Computing 8 Pages
대한전자공학회 IEIE Transactions on Smart Processing and Computing 2014, Vol.3 No.3 110-117 (8 pages)
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DSP-FPGA 구조를 갖는 다중경로 페이딩 채널 시뮬레이터 구현
이주현, 이찬길 한국음향학회 한국음향학회지= The journal of the acoustical society of Korea 7 Pages
한국음향학회 한국음향학회지= The journal of the acoustical society of Korea 2004, Vol.23 No.1 17-23 (7 pages)
본 논문에서는 TMS320C6414 DSP칩과 XC2VP30 FPGA칩을 사용한 페이딩 신호의 실시간발생에 대해 기술한다. 여기서 제시된 시뮬레이터는 플랫 페이딩 및 주파수 선택성 페이딩 채널의 일반적인 모델로 그 대상으로 하였으며 여러 다양한 채널 왜곡 현상을 모사할 수 있도록 설계되었다. 시뮬레이터는 다음 세가지 기본적인 채널 특성을 포함한다; 레일리 페이딩, log-normal shadowing, 주파수 선택성 페이딩. DSP의 연산부담을 최소로 하면서 이동 채널의 통계 특성을 재현하기 위해 multi-rate신호처리 기법이 사용되었다. 채널 파라미터... -
HMM(Hidden Markov Model) 기반의 견고한 실시간 립리딩을 위한 효율적인 VLSI 구조 설계 및 FPGA 구현을 이용한 검증
이지근, 김명훈, 이상설, 정성태, Lee. Chi-Geun, Kim. Myung-Hun, Lee. Sang-Seol, Jung. Sung-Tae 한국컴퓨터정보학회 韓國컴퓨터情報學會論文誌 9 Pages
한국컴퓨터정보학회 韓國컴퓨터情報學會論文誌 2006, Vol.11 No.2 159-167 (9 pages)
실시간 처리와 구현의 용이성을 위하여 본 논문에서는 립리딩 시스템을 이미지 획득 모듈, 특징 벡터 추출 모듈, 인식 모듈의 세 모듈로 분할하였다. 이미지 획득 모듈에서는 CMOS 이미지 센서를 사용하여 입력 영상을 획득하게 하였고, 특징 벡터 추출 모듈에서는 병렬 블록매칭 알고리즘을 이용하여 입력영상으로부터 특징벡터를 추출하도록 하였고, 이를 FPGA로 코딩하여 시뮬레이션 하였다. 인식 모듈에서는 추출된 특징 벡터에 대하여 HMM 기반 인식 알고리즘을 적용하여 발성한 단어를 인식하도록 하였고, 이를 DSP에 코딩하여... -
합성곱 신경망 연산 처리를 위한 ALU 설계
남기훈 인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 8 Pages
인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 2017, 제 7권 제 11호 84 879-886 (8 pages)
해결하고자 최근에 들어 기존 CPU 및 GPU보다 수 배에서 수십 배 높은 신경 네트워크 연산을 가속화하려는 연구가 활발이 이루어져 다양한 IPU 및 TPU가 개발되고 있다. 본 논문에서는 CNN의 다중 곱셈과 덧셈을 효과적으로 계산하기 위한 ALU를 제안한다. ALU 설계는 Verilog HDL을 사용하여 Xilinx VC-707 FPGA 보드에 구현하였다. 8비트 수정 Booth 곱셈기 25개를 정방행렬 구조로 설계하였으며 클럭당 200비트를 처리하게 하였다. 연산속도 향상을 위하여 연산기는 파이프라이닝을 이용한 병렬처리를 하였다. 실험은 MNIST의 숫자... -
이기종 컴퓨팅을 활용한 환율 예측 뉴럴 네트워크 구현
한성현, 이광엽 인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 9 Pages
인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 2017, 제 7권 제 11호 7 71-79 (9 pages)
두 과정을 거친다. 학습은 CPU를 활용했다. 검증에는 Verilog HDL로 작성된 RTL을 FPGA에서 동작 시켰다. 해당 뉴럴 네트워크의 구조는 입력 뉴런 네 개, 히든 뉴런 네 개, 출력 뉴런 한 개를 가진다. 입력 뉴런에는 미국 1달러, 일본 100엔, EU 1유로, 영국 1파 운드의 원화 가치를 사용했다. 입력 뉴런들을 통해 캐나다 1달러의 원화가치를 예측 했다. 환율을 예 측 하는 순서는 입력, 정규화, 고정 소수점 변환, 뉴럴 네트워크 순방향, 부동 소수점 변환, 역정규화, 출력 과정을 거친다. 2016년 11월의 환율을 예측한 결과 0.9원에서... -
A study of digital currency cryptography for business marketing and finance security
Tai-hoon Kim 인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 12 Pages
인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 2016, 제 6권 제 1호 36 365-376 (12 pages)
A medium of exchange is an intermediary used in trade or business to avoid the inconveniences of a pure barter system. While many things could be used as a medium of exchange in an economy, fiat money including currency bills and coins is the most common and generally accepted as a unit of account which is deemed to represent a standard and store of value. In engaging in e-commerce, people may opt to send money through money remittance agents or through banks for a fee. The Age of the Internet... -
Linear Prediction Analysis and Quantization for the Conjugate-Structure Algebraic-Code-Excited Linear-Prediction Speech Compression Algorithm
Marcus L. George 인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 12 Pages
인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 2012, 제 2권 제 1호 5 33-44 (12 pages)
QoS of a VoIP system. This paper presents the hardware implementation of the Linear Prediction (LP) Analysis and Quantization component of the Conjugate-Structure Algebraic-Code-Excited Linear-Prediction (CS-ACELP) speech compression algorithms. The LP Analysis and Quantization units were implemented in hardware using Xilinx 11.1 ISE, after which ITU-T test vectors were used to determine whether they were equivalent implementations of the LP Analysis and Quantization. The algorithmic delays of... -
Open-Loop Pitch Analysis for the Conjugate-Structure Algebraic-Code-Excited Linear-Prediction Speech Compression Algorithm
Geetam Singh Tomar, Marcus L. George 인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 10 Pages
인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 2011, 제 1권 제 1호 5 41-50 (10 pages)
VoIP system. This paper presents the hardware implementation of the Open-Loop Pitch Analysis component of the Conjugate-Structure Algebraic-Code-Excited Linear-Prediction (CS-ACELP) speech compression algorithms. The Open-Loop Pitch Analysis units were implemented in hardware using Xilinx 11.1 ISE, after which ITU-T test vectors were used to determine whether they were equivalent implementations of the Open-Loop Pitch Analysis. The algorithmic delays of hardware-implementations were obtained via...
