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고속 ATE 시스템을 위한 임피던스 정합회로 구현
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  • 고속 ATE 시스템을 위한 임피던스 정합회로 구현
  • Implementation of Impedance Matching Circuit for ATE
저자명
김종원,서용배,이용성,Kim. Jong-Won,Seo. Yong-Bae,Lee. Yong-Sung
간행물명
반도체및디스플레이장비학회지
권/호정보
2006년|5권 4호|pp.17-22 (6 pages)
발행정보
한국반도체및디스플레이장비학회
파일정보
정기간행물|
PDF텍스트
주제분야
기타
이 논문은 한국과학기술정보연구원과 논문 연계를 통해 무료로 제공되는 원문입니다.
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기타언어초록

In the manufacturing processes of semiconductor, test process is important for quality of products. In the manufacturing process of dynamic memory, memory test is more important. So, automatic test equipment(ATE) is used necessarily. But, according to increase of speed of dynamic memory operation, the rapid test equipment is needed. Impedance matching between ATE and dynamic memory is expected to be an important problem for making a rapid test equipment over 1Gbps. According to increase of speed, inner impedance of ATE also works on important parameter for test. This paper is about the method that is for impedance matching of inner impedance and coaxial cable occurring in manufacturing of ATE. We proved effects of inner impedance by electric theory and verified the method of impedance matching using computer simulation.