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Development of Hardware-in-the-Loop Simulation System for Use in Design and Validation of VDC Logics
Park. Kihong, Heo. Seung-Jin 한국정밀공학회 International journal of the Korean society of precision engineering 8 Pages
한국정밀공학회 International journal of the Korean society of precision engineering 2003, Vol.4 No.3 28-35 (8 pages)
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LotG: A Design of Adaptive u-learning System
Yvette E. Gelogo, Hyejin Kim 인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 11 Pages
인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 2015, 제 5권 제 3호 25 239-249 (11 pages)
everyday lives. In this age of progress and great change, we tend to easily adapt to the technologies and pedagogies that emerge. Ubiquitous technology and u-learning may be the new hope for the future of education. We want that learning doesn’t only happen in four corners of classroom, house or inside the building but learning should be anytime and anywhere with the help of technologies. In this paper, we proposed a concept of LotG (Learning on the Go), a design of adaptive u-learning system. -
Hardware Implementation of Pulse Code Modulation Speech Compression Algorithm
Geetam Singh Tomar 인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 8 Pages
인문사회과학기술융합학회 예술인문사회융합멀티미디어논문지 2012, 제 2권 제 1호 3 17-24 (8 pages)
loss. This paper served to demonstrate that the algorithmic delay (latency) of the Pulse Code Modulation (PCM) speech compression algorithm which has originally been implemented in software can be significantly reduced by implementation in hardware. The PCM speech compression algorithm is first implemented, verified to demonstrate equivalence and then validated by comparing the latency of the hardware-implemented speech compression algorithm with that of an existing software implementation. -
Design of Iterative Divider in GF(2163) Based on Improved Binary Extended GCD Algorithm
강민섭, 전병찬, Kang. Min-Sup, Jeon. Byong-Chan 한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part C Part C 8 Pages
한국정보처리학회 정보처리학회논문지. The KIPS transactions. Part C Part C 2010, No.0 145-152 (8 pages)
상에서개선된 나눗셈 알고리듬을 제안하고, 제안한 알고리듬을 기반으로 한 반복 하드웨어 구조(iterative hardware structure)를 갖는 고속 나눗셈기를 설계한다. 제안한알고리듬은 이진 확장 GCD 알고리듬을 기본으로 하고 있으며, 모듈러감소 (modular reduction)를 위한 모든 산술연산은 기존의 방법과 달리 하나의 while루프 내에서 수행된다. 제안된 알고리듬을 기본으로 하여 설계된 나눗셈기는 모듈러 연산을 위한 각 모듈이 하나의 클럭에 의해서제어되므로 계산 속도가 매우 빠르다. 여기에서 사용하는 감소 다항식(reduction... -
WASTE CLASSIFICATION OF 17×17 KOFA SPENT FUEL ASSEMBLY HARDWARE
Cho. Dong-Keun, Kook. Dong-Hak, Choi. Jong-Won, Choi. Heui-Joo 한국원자력학회 Nuclear engineering and technology : an international journal of the Korean Nuclear Society 10 Pages
한국원자력학회 Nuclear engineering and technology : an international journal of the Korean Nuclear Society 2011, Vol.43 No.2 149-158 (10 pages)
